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參數(shù)資料
| 型號： | CY7C133-55JC |
| 廠商： | CYPRESS SEMICONDUCTOR CORP |
| 元件分類： | DRAM |
| 英文描述： | 2K x 16 Dual-Port Static RAM |
| 中文描述： | 2K X 16 DUAL-PORT SRAM, 55 ns, PQCC68 |
| 封裝： | PLASTIC, LCC-68 |
| 文件頁數(shù)： | 10/13頁 |
| 文件大?。?/td> | 506K |
| 代理商： | CY7C133-55JC |
CY7C133
CY7C143
Document #: 38-06036 Rev. *B
Page 10 of 13
Write Cycle No. 2 (R/W Three-States Data I/Os—Either Port)
[23, 28]
Busy Timing Diagram No. 1 (CE Arbitration)
Note:
28. If the CE LOW transition occurs simultaneously with or after the R/W LOW transition, the outputs remain in the high-impedance state.
Switching Waveforms
(continued)
t
AW
t
WC
t
SCE
t
SA
t
PWE
t
HD
t
SD
t
HZWE
Either Port
t
HA
HIGH IMPEDANCE
DATAVALID
t
LZWE
ADDRESS
CE
R/W
DATA
IN
DATA
OUT
ADDRESS
ADDRESS MATCH
t
PS
CE
L
Valid First:
t
BLC
t
BHC
ADDRESS MATCH
t
PS
t
BLC
t
BHC
CE
R
Valid First:
L,R
BUSY
R
CE
L
CE
R
BUSY
L
CE
R
CE
L
ADDRESS
L,R
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PDF描述 |
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