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參數(shù)資料
| 型號(hào)： | DJIXFEAD0QE001 |
| 廠商： | Intel Corp. |
| 英文描述： | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| 中文描述： | 先進(jìn)的8端口10/100 Mbps的物理層收發(fā)器 |
| 文件頁數(shù)： | 139/226頁 |
| 文件大小： | 1575K |
| 代理商： | DJIXFEAD0QE001 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁當(dāng)前第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁第225頁第226頁
LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers
Datasheet
Document Number: 249241
Revision Number: 007
Revision Date: August 28, 2003
141
4.8
RMII Operation
The LXT9785/LXT9785E provides an independent Reduced MII port for each network port. Each
RMII uses four signals to pass received data to the MAC: RxData
n
<1:0>, RxER
n
, and CRS_DV
n
(where
n
reflects the port number). Three signals are used to transmit data from the MAC:
TxData
n
_<1:0> and TxEN
n
. Both receive and transmit signals are clocked by REFCLK. Data
transmission across the RMII is implemented in di-bit pairs which equal a 4-bit wide nibble.
Note:
The BGA15 package does not support the RMII interface.
4.8.1
RMII Reference Clock
The LXT9785/LXT9785E requires a 50 MHz reference clock (REFCLK). The device samples the
RMII input signals on the rising edge of REFCLK and drives RMII output signals on the falling
edge.
Figure 22. Intel
LXT9785/LXT9785E SS-SMII Transmit Timing
Figure 23. Intel
LXT9785/LXT9785E SS-SMII Receive Timing
TxCLK
TxSYNC
TxData
All signals are synchronous to the clock
TXER TXEN
TXD2
TXD0 TXD1
TXD3 TXD4 TXD5
TXD7
TXD6
TxCLK
TxSYNC
TxData
TXER
Dplx
Frcerr Speed
Jabr
LINK
TXEN
TXER
TXER
RxCLK
RxSYNC
RxData
All signals are synchronous to the clock
CRS RXDV
RXD2
RXD0 RXD1
RXD3 RXD4 RXD5
RXD7
RXD6
RxCLK
RxSYNC
RxData
CRS
Dplx
RXERSpeed
UPnib
Jabr
FlsCar
LINK
RXDV
CRS
CRS
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DJIXFEAD0SE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFEAD0SE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFECD0QE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFECD0QE001 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFECD0SE000 | Advanced 8-Port 10/100 Mbps PHY Transceivers |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| DJIXFEAD0SE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFEAD0SE001 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFECD0QE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFECD0QE001 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
| DJIXFECD0SE000 | 制造商:INTEL 制造商全稱:Intel Corporation 功能描述:Advanced 8-Port 10/100 Mbps PHY Transceivers |
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