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參數(shù)資料

型號：	DJIXPEAD0QE000
廠商：	Intel Corp.
英文描述：	Advanced 8-Port 10/100 Mbps PHY Transceivers
中文描述：	先進的8端口10/100 Mbps的物理層收發(fā)器
文件頁數(shù)：	71/226頁
文件大?。?/td>	1575K
代理商：	DJIXPEAD0QE000

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LXT9785 and LXT9785E Advanced 8-Port 10/100 Mbps PHY Transceivers

Datasheet

Document Number: 249241

Revision Number: 007

Revision Date: August 28, 2003

73

GNDR

P6

AO/AI

Table 30 (page 88)

GNDR

P13

AO/AI

Table 30 (page 88)

GNDR

R7

AO/AI

Table 30 (page 88)

GNDR

R9

AO/AI

Table 30 (page 88)

GNDR

R11

AO/AI

Table 30 (page 88)

GNDR

R13

AO/AI

Table 30 (page 88)

GNDR

U8

–

Table 34 (page 95)

GNDT

P14

AO/AI

Table 30 (page 88)

GNDT

R1

AO/AI

Table 30 (page 88)

GNDT

R3

AO/AI

Table 30 (page 88)

GNDT

R5

AO/AI

Table 30 (page 88)

GNDT

R15

O, TS, SL,

ID

Table 24 (page 82)

GNDT

R17

I, ID

Table 24 (page 82)

GNDT

T17

–

Table 34 (page 95)

GNDT

U2

–

Table 34 (page 95)

GNDT

U4

–

Table 34 (page 95)

GNDT

U6

–

Table 34 (page 95)

GNDT

U10

–

Table 34 (page 95)

GNDT

U12

–

Table 34 (page 95)

GNDT

U14

–

Table 34 (page 95)

GNDT

U16

–

Table 34 (page 95)

GNDT

U17

–

Table 34 (page 95)

LED0_1

K3

–

–

LED0_2

K2

–

–

LED0_3

J1

–

Table 35 (page 97)

LED1_1

J4

–

Table 35 (page 97)

LED1_2

J3

–

Table 35 (page 97)

LED1_3

H1

I, ID

Table 24 (page 82)

LED2_1

H2

O, TS, SL,

ID

Table 24 (page 82)

LED2_2

H3

I, ID

Table 24 (page 82)

LED2_3

G1

O, TS, SL,

ID

Table 32 (page 90)

LED3_1

F2

OD, TS,

SL, IP

Table 33 (page 94)

LED3_2

G3

I, ST, ID

Table 32 (page 90)

LED3_3

G4

–

Table 24 (page 82)

LED4_1

K16

–

–

LED4_2

K17

–

–

Signal

Ball

Type

1

Reference for

Full Description

LED4_3

J17

–

–

LED5_1

J15

–

–

LED5_2

J16

–

–

LED5_3

H17

–

Table 35 (page 97)

LED6_1

H15

–

Table 35 (page 97)

LED6_2

H16

–

Table 35 (page 97)

LED6_3

G17 –

Table 24 (page 82)

LED7_1

G15 I, ID

Table 24 (page 82)

LED7_2

F17

I/O, TS,

SL, IP

Table 28 (page 87)

LED7_3

F16

I/O, TS,

SL, IP

Table 28 (page 87)

LINKHOLD

A17

O, TS, SL

Table 24 (page 82)

MDC0

E1

–

Table 34 (page 95)

MDC1

B10

–

Table 34 (page 95)

MDDIS

L1

–

–

MDINT0

F1

OD, TS,

SL, IP

Table 33 (page 94)

MDINT1

C9

–

Table 34 (page 95)

MDIO0

F3

OD, TS,

SL, IP

Table 33 (page 94)

MDIO1

A10

O, TS, SL

Table 24 (page 82)

MDIX

D2

I, ST

Table 34 (page 95)

ModeSel0

L16

–

–

ModeSel1

L17

–

–

N/C

A3

I, ST, ID

Table 32 (page 90)

N/C

A4

I, ST, ID

Table 32 (page 90)

N/C

A7

I, ST, ID

Table 32 (page 90)

N/C

A13

O, TS, SL

Table 24 (page 82)

N/C

A14

O, TS, SL

Table 24 (page 82)

N/C

A16

O, TS, SL

Table 24 (page 82)

N/C

B2

–

Table 34 (page 95)

N/C

B6

–

Table 34 (page 95)

N/C

B11

–

Table 34 (page 95)

N/C

B14

–

Table 34 (page 95)

N/C

C2

–

Table 34 (page 95)

N/C

C6

–

Table 34 (page 95)

N/C

C8

–

Table 34 (page 95)

N/C

C10

–

Table 34 (page 95)

N/C

C14

–

Table 34 (page 95)

Signal

Ball

Type

1

Reference for

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DJIXPEAD0SE000	Advanced 8-Port 10/100 Mbps PHY Transceivers
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