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參數(shù)資料
| 型號： | DS1045S-5 |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 5/6頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DELAY LINE 16TAP 16-SOIC |
| 標(biāo)準(zhǔn)包裝： | 45 |
| 標(biāo)片/步級數(shù)： | 16 |
| 功能： | 多重，可編程 |
| 延遲到第一抽頭： | 9ns |
| 接頭增量： | 5ns |
| 可用的總延遲： | 84ns |
| 獨(dú)立延遲數(shù)： | 2 |
| 電源電壓： | 4.75 V ~ 5.25 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-SOIC（0.295"，7.50mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 16-SOIC W |
| 包裝： | 管件 |
DS1045
5 of 6
CAPACITANCE
(TA = 25°C)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
NOTES
Input Capacitance
CIN
10
pF
TEST CONDITIONS
TA=25
°C ±=3°C
VCC= 5.0V
±=0.1V
Input Pulse = 3.0V high to 0.0V low
±=0.1V
Input Source Impedance = 50
maximum
Rise and fall times = 3.0ns max. between 0.6V and 2.4V
Pulse Width = 250ns
Period = 500ns
Output Load = 74F04
Measurement Point = 1.5V on inputs and outputs
Output Load Capacitance = 15pF
NOTE:
Above conditions are for test only and do not restrict the operation of the device under other data sheet
conditions.
TIMING DIAGRAM: NON-LATCHED PARALLEL MODE, EA , EB = VIH
TIMING DIAGRAM: LATCHED PARALLEL MODE
相關(guān)PDF資料 |
PDF描述 |
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| DS1007S-6 | IC DELAY LINE 6NS 16-SOIC |
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參數(shù)描述 |
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