參數資料
型號： DS26502L+
廠商： Maxim Integrated Products
文件頁數： 111/125頁
文件大?。?/td> 0K
描述： IC T1/E1/J1 64KCC ELEMENT 64LQFP
產品培訓模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標準包裝： 160
類型： BITS 元件，多路復用器
PLL： 是
主要目的： T1/E1
輸入： 時鐘
輸出： 時鐘
電路數： 1
比率 - 輸入:輸出： 2:3
差分 - 輸入:輸出： 無/無
頻率 - 最大： 6.312MHz
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 64-LQFP
供應商設備封裝： 64-LQFP（10x10）
包裝： 托盤
產品目錄頁面： 1430 (CN2011-ZH PDF)
DS26502 T1/E1/J1/64KCC BITS Element
86 of 125
Register Name:
LIC4
Register Description:
Line Interface Control 4
Register Address:
33h
Bit #
7
6
5
4
3
2
1
0
Name
MPS1
MPS0
TT2
TT1
TT0
RT2
RT1
RT0
Default
0
HW
Mode
MPS1
PIN 16
MPS0
PIN 15
—
Bits 0 to 2: Receive Termination Select (RT0 to RT2)
RT2
RT1
RT0
INTERNAL RECEIVE
TERMINATION CONFIGURATION
0
Internal Receive-Side Termination Disabled
0
1
Internal Receive-Side 75 Enabled
0
1
0
Internal Receive-Side 100 Enabled
0
1
Internal Receive-Side 120 Enabled
1
0
Internal Receive-Side 110 Enabled
1
0
1
Internal Receive-Side Termination Disabled
1
0
Internal Receive-Side Termination Disabled
1
Internal Receive-Side Termination Disabled
Bits 3 to 5:Transmit Termination Select (TT0 to TT2)
TT2
TT1
TT0
INTERNAL TRANSMIT
TERMINATION CONFIGURATION
0
Internal Transmit-Side Termination Disabled
0
1
Internal Transmit-Side 75 Enabled
0
1
0
Internal Transmit-Side 100 Enabled
0
1
Internal Transmit-Side 120 Enabled
1
0
Internal Transmit-Side 110 Enabled
1
0
1
Internal Transmit-Side Termination Disabled
1
0
Internal Transmit-Side Termination Disabled
1
Internal Transmit-Side Termination Disabled
Bits 6 and 7: MCLK Pre-Scaler (MPS0 to MPS1) (T1 Mode)
MCLK (MHz)
MPS1
MPS0
JACKS (LIC2.3)
1.544
0
3.088
0
1
0
6.176
1
0
12.352
1
0
2.048
0
1
4.096
0
1
8.192
1
0
1
16.384
1
Bits 6 and 7: MCLK Pre-Scaler (MPS0 to MPS1) (E1 Mode)
MCLK (MHz)
MPS1
MPS0
JACKS0 (LIC2.3)
JACKS1 (LIC2.7)
2.048
0
4.096
0
1
0
8.192
1
0
12.8
0
1
16.384
1
0
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PDF描述
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參數描述
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