(VDD = 3.3V ±5" />
參數(shù)資料
型號(hào)： DS3170N+
廠(chǎng)商： Maxim Integrated Products
文件頁(yè)數(shù)： 131/230頁(yè)
文件大?。?/td> 0K
描述： IC TXRX DS3/E3 100-CSBGA
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 640
功能： 單芯片收發(fā)器
接口： DS3，E3
電路數(shù)： 1
電源電壓： 3.135 V ~ 3.465 V
電流 - 電源： 120mA
工作溫度： -40°C ~ 85°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 100-LBGA，CSBGA
供應(yīng)商設(shè)備封裝： 100-CSBGA（11x11）
包裝： 托盤(pán)
包括： DS3 調(diào)幀器，E3 調(diào)幀器，HDLC 控制器，芯片內(nèi) BERT
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DS3170 DS3/E3 Single-Chip Transceiver
216 of 230
Table 16-3. Misc Timing
(VDD = 3.3V ±5%, Tj = -40°C to +125°C.)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
Asynchronous Input High, Low Time
t1-t2, t2
(Note 1)
500
ns
Asynchronous Input Rise, Fall Time
t3
(Note 1)
10
ns
Note 1:
TMEI (GPIO), PMU (GPIO), 8KREFI (GPIO) and
RST inputs.
16.2 Overhead Port AC Characteristics
All AC timing characteristics are specified with a 25 pF capacitive load on all output pins, VIH = 2.4V and VIL = 0.8.
The voltage threshold for all timing measurements is VDD/2. The generic timing definitions shown in Figure 16-1,
Figure 16-2, Figure 16-3, and Figure 16-4 apply to this interface.
Table 16-4. Overhead Port Timing
(VDD = 3.3V ±5%, Tj = -40°C to +125°C.)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
CLK Period
t1
(Note 1)
500
ns
CLK Clock High and Low Time
t1-t2, t2
(Note 1)
200
ns
DIN to CLK Setup Time
t5
(Note 2)
20
ns
CLK to DIN Hold Time
t6
(Note 2)
20
ns
CLK to DOUT Delay
t7
(Note 3)
-20
20
ns
Note 1:
TOHCLK, ROHCLK output clocks.
Note 2:
TOHCLK clock falling edge outputs to TOH, TOHEN inputs.
Note 3:
TOHCLK, ROHCLK clock falling edge outputs to TOHSOF, ROH, ROHSOF outputs.
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