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參數(shù)資料
| 型號(hào)： | DS3171N |
| 英文描述： | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| 中文描述： | 單/雙/三/四DS3/E3單芯片收發(fā)器 |
| 文件頁(yè)數(shù)： | 26/232頁(yè) |
| 文件大?。?/td> | 2133K |
| 代理商： | DS3171N |
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DS3171/DS3172/DS3173/DS3174
26 of 230
NAME
TYPE
FUNCTION
PIN #
Microprocessor Interface
Data [15:0]
D[15]
D[14]
D[13]
D[12]
D[11]
D[10]
D[9]
D[8]
D[7]
D[6]
D[5]
D[4]
D[3]
D[2]
D[1]
D[0]
A[10]
A[9]
A[8]
A[7]
A[6]
A[5]
A[4]
A[3]
A[2]
A[1]
A[0] / BSWAP
ALE
CS
RD
/
DS
IO
J5
T4
R4
P4
N4
V3
U3
T3
P3
N3
W2
U2
T2
P2
U1
P1
C3
D3
E3
G3
H3
D2
E2
G2
H2
E1
H1
N2
L3
K3
I
Address [10:1]
Address [0] / Byte Swap
Address Latch Enable
Chip Select (active low)
Read Strobe (active low) / Data Strobe (active
low)
Write Strobe (active low) / R/
W
Select
Ready handshake (active low)
Interrupt (active low)
Mode select RD/WR or DS strobe mode
WIDTH select 8 or 16-bit interface
Misc I/O
General-Purpose IO [8:1]
I
I
I
WR
/ R
/W
RDY
INT
MODE
WIDTH
I
K4
K2
L4
B1
L5
Oz
Oz
I
I
GPIO[8]
GPIO[7]
GPIO[6]
GPIO[5]
GPIO[4]
GPIO[3]
GPIO[2]
GPIO[1]
TEST
HIZ
RST
IO
V2
V1
C2
C1
P5
R5
G5
F5
M3
R3
B16
I
I
I
Test enable (active low)
High impedance test enable (active low)
Reset (active low)
JTAG
JTCLK
JTMS
JTDI
JTDO
I
JTAG Clock
JTAG Mode Select (with pull-up)
JTAG Data Input (with pull-up)
JTAG Data Output
F3
F4
J3
G4
Ipu
Ipu
Oz
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| DS3172 | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
| DS3172N | Single/Dual/Triple/Quad DS3/E3 Single-Chip Transceivers |
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參數(shù)描述 |
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