(VCC = 5V" />
參數(shù)資料
型號(hào)： DS5001FP-16
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 6/27頁(yè)
文件大小： 0K
描述： IC MPU 128K 16MHZ 80-TQFP
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 66
系列： DS500x
核心處理器： 8051
芯體尺寸： 8-位
速度： 16MHz
連通性： EBI/EMI，SIO，UART/USART
外圍設(shè)備： 電源故障復(fù)位，WDT
輸入/輸出數(shù)： 32
程序存儲(chǔ)器類型： SRAM
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 4.5 V ~ 5.5 V
振蕩器型： 外部
工作溫度： 0°C ~ 70°C
封裝/外殼： 80-BQFP
包裝： 托盤
DS5001FP
14 of 27
AC CHARACTERISTICS: EXPANDED BUS MODE TIMING SPECIFICATIONS
(VCC = 5V ±10%, TA = 0°C to +70°C.)
#
PARAMETER
SYMBOL
MIN
MAX
UNITS
1
Oscillator Frequency
1/ tCLK
1.0
16
MHz
2
ALE Pulse Width
tALPW
2tCLK - 40
ns
3
Address Valid to ALE Low
tAVALL
tCLK - 40
ns
4
Address Hold After ALE Low
tAVAAV
tCLK - 35
ns
at 12MHz
4tCLK - 150
5
ALE Low to Valid Instruction In
at 16MHz
tALLVI
4tCLK - 90
ns
6
ALE Low to PSEN Low
tALLPSL
tCLK - 25
ns
7
PSEN
Pulse Width
tPSPW
3tCLK - 35
ns
at 12MHz
3tCLK - 150
8
PSEN
Low to Valid Instruction
In
at 16MHz
tPSLVI
3tCLK - 90
ns
9
Input Instruction Hold After PSEN Going High
tPSIV
0
ns
10
Input Instruction Float After PSEN Going High
tPSIX
tCLK - 20
ns
11
Address Hold After PSEN Going High
tPSAV
tCLK - 8
ns
at 12MHz
5tCLK - 150
12
Address Valid to Valid
Instruction In
at 16MHz
tAVVI
5tCLK - 90
ns
13
PSEN
Low to Address Float
tPSLAZ
0
ns
14
RD
Pulse Width
tRDPW
6tCLK - 100
ns
15
WR
Pulse Width
tWRPW
6tCLK - 100
ns
at 12MHz
5tCLK - 165
16
RD
Low to Valid Data In
at 16MHz
tRDLDV
5tCLK - 105
ns
17
Data Hold After RD High
tRDHDV
0
ns
18
Data Float After RD High
tRDHDZ
2tCLK - 70
ns
at 12MHz
8tCLK - 150
19
ALE Low to Valid Data In
at 16MHz
tALLVD
8tCLK - 90
ns
at 12MHz
9tCLK - 165
20
Valid Address to Valid Data In
at 16MHz
tAVDV
9tCLK - 105
ns
21
ALE Low to RD or WR Low
tALLRDL
3tCLK - 50
3tCLK + 50
ns
22
Address Valid to RD or WR Low
tAVRDL
4tCLK - 130
ns
23
Data Valid to WR Going Low
tDVWRL
tCLK - 60
ns
at 12MHz
7tCLK - 150
24
Data Valid to WR High
at 16MHz
tDVWRH
7tCLK - 90
ns
25
Data Valid After WR High
tWRHDV
tCLK - 50
ns
26
RD
Low to Address Float
tRDLAZ
0
ns
27
RD
or WR High to ALE High
tRDHALH
tCLK - 40
tCLK + 50
ns
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PDF描述
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參數(shù)描述
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