The timing waveforms sh" />
參數(shù)資料
型號(hào)： DSP56311VF150B1
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 17/96頁(yè)
文件大小： 0K
描述： IC DSP 24BIT 150MHZ 196-BGA
標(biāo)準(zhǔn)包裝： 630
系列： DSP56K/Symphony
類(lèi)型： 定點(diǎn)
接口： 主機(jī)接口，SSI，SCI
時(shí)鐘速率： 150MHz
非易失內(nèi)存： ROM（576 B）
芯片上RAM： 384kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.80V
工作溫度： -40°C ~ 100°C
安裝類(lèi)型： 表面貼裝
封裝/外殼： 196-LBGA
供應(yīng)商設(shè)備封裝： 196-MAPBGA（15x15）
包裝： 托盤(pán)
DSP56311 Technical Data, Rev. 8
2-4
Freescale Semiconductor
Specifications
2.4 AC Electrical Characteristics
The timing waveforms shown in the AC electrical characteristics section are tested with a VIL maximum of 0.3 V
and a VIH minimum of 2.4 V for all pins except EXTAL, which is tested using the input levels shown in Note 6 of
Table 2-2. AC timing specifications, which are referenced to a device input signal, are measured in production with
respect to the 50 percent point of the respective input signal’s transition. DSP56311 output levels are measured
with the production test machine VOL and VOH reference levels set at 0.4 V and 2.4 V, respectively.
Note:
Although the minimum value for the frequency of EXTAL is 0 MHz, the device AC test conditions are 15
MHz and rated speed.
2.4.1
Internal Clocks
Table 2-4.
Internal Clocks
Characteristics
Symbol
Expression
Min
Typ
Max
Internal operation frequency with PLL
enabled
f—
(Ef
× MF)/
(PDF
× DF)
—
Internal operation frequency with PLL
disabled
f—
Ef/2
—
Internal clock high period
With PLL disabled
With PLL enabled and MF
≤4
With PLL enabled and MF > 4
TH
—
0.49
× ET
C ×
PDF
× DF/MF
0.47
× ETC ×
PDF
× DF/MF
ETC
—
0.51
× ET
C ×
PDF
× DF/MF
0.53
× ETC ×
PDF
× DF/MF
Internal clock low period
With PLL disabled
With PLL enabled and
MF
≤4
With PLL enabled and
MF > 4
TL
—
0.49
× ET
C ×
PDF
× DF/MF
0.47
× ETC ×
PDF
× DF/MF
ETC
—
0.51
× ET
C ×
PDF
× DF/MF
0.53
× ETC ×
PDF
× DF/MF
Internal clock cycle time with PLL enabled
TC
—ETC × PDF ×
DF/MF
—
Internal clock cycle time with PLL disabled
TC
—2
× ET
C
—
Instruction cycle time
ICYC
—TC
—
Notes:
1.
DF = Division Factor; Ef = External frequency; ETC = External clock cycle; MF = Multiplication Factor;
PDF = Predivision Factor; TC = internal clock cycle.
2.
See the PLL and Clock Generation section in the
DSP56300 Family Manual for a details on the PLL.
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DSP56311VL150 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC 24 BIT DSP PBFREE RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線(xiàn)寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
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