The phase jitter o" />
參數(shù)資料
型號: DSP56311VF150B1
廠商: Freescale Semiconductor
文件頁數(shù): 73/96頁
文件大?。?/td> 0K
描述: IC DSP 24BIT 150MHZ 196-BGA
標準包裝: 630
系列: DSP56K/Symphony
類型: 定點
接口: 主機接口,SSI,SCI
時鐘速率: 150MHz
非易失內(nèi)存: ROM(576 B)
芯片上RAM: 384kB
電壓 - 輸入/輸出: 3.30V
電壓 - 核心: 1.80V
工作溫度: -40°C ~ 100°C
安裝類型: 表面貼裝
封裝/外殼: 196-LBGA
供應商設備封裝: 196-MAPBGA(15x15)
包裝: 托盤
PLL Performance Issues
DSP56311 Technical Data, Rev. 8
Freescale Semiconductor
4-5
4.4.2
Phase Jitter Performance
The phase jitter of the PLL is defined as the variations in the skew between the falling edges of EXTAL and CLKOUT
for a given device in specific temperature, voltage, input frequency, MF, and capacitive load on CLKOUT. These
variations are a result of the PLL locking mechanism. For input frequencies greater than 15 MHz and MF
≤4, this
jitter is less than
±0.6 ns; otherwise, this jitter is not guaranteed. However, for MF < 10 and input frequencies
greater than 10 MHz, this jitter is less than
±2 ns.
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