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參數(shù)資料
| 型號(hào)： | DSP56857E |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 英文描述： | 16-bit Digital Signal Controllers |
| 中文描述： | 16位數(shù)字信號(hào)控制器 |
| 文件頁(yè)數(shù)： | 41/53頁(yè) |
| 文件大小： | 680K |
| 代理商： | DSP56857E |
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Serial Communication Interface (SCI) Timing
56857 Technical Data, Rev. 6
Freescale Semiconductor
41
Figure 4-27 Slave Mode Clock Timing
4.11 Serial Communication Interface (SCI) Timing
Table 4-13 SCI Timing
4
Operating Conditions: V
SS
= V
SSIO
= V
SSA
= 0 V, V
DD
= 1.62-1.98V, V
DDIO
= V
DDA
=
3.0–3.6V, T
A
= –40
°
to +120
°
C, C
L
≤
50pF, f
op
= 120MHz
Characteristic
Symbol
Min
Max
Unit
Baud Rate
1
1.
f
MAX
is the frequency of operation of the system clock in MHz.
The RXD pin in SCI0 is named RXD0 and the RXD pin in SCI1 is named RXD1.
BR
—
(f
MAX
)/(32)
Mbps
RXD
2
Pulse Width
2.
RXD
PW
0.965/BR
1.04/BR
ns
TXD
3
Pulse Width
3.
The TXD pin in SCI0 is named TXD0 and the TXD pin in SCI1 is named TXD1.
4.
Parameters listed are guaranteed by design.
TXD
PW
0.965/BR
1.04/BR
ns
t
THS
t
TSS
t
HS
t
SS
t
RFSWLS
t
RFSWHS
t
RFBLS
t
RFSBHS
t
TXHIS
t
TXNVS
t
FTXVS
t
TXVS
t
TXES
t
FTXES
t
TFSWLS
t
TFSWHS
t
TFSBLS
t
TFSBHS
t
SCKL
t
SCKW
t
SCKH
First Bit
Last Bit
SCK input
SC2 (bl) input
SC2 (wl) input
STD
SC0 input
SC1 (bl) input
SC1 (wl) input
SRD
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