參數(shù)資料
型號(hào)： DSPIC30F5015-30I/PT
廠商： Microchip Technology
文件頁數(shù)： 4/129頁
文件大?。?/td> 0K
描述： IC DSPIC MCU/DSP 66K 64TQFP
產(chǎn)品培訓(xùn)模塊： dsPIC30F Quadrature Encoder Interface
Serial Communications using dsPIC30F CAN
Serial Communications using dsPIC30F I2C
Serial Communications using dsPIC30F SPI
Serial Communications using dsPIC30F UART
dsPIC30F 12 bit ADC - Part 2
dsPIC30F Addressing Modes - Part 1
dsPIC30F Architecture - Part 1
dsPIC30F DSP Engine & ALU
dsPIC30F Interrupts
dsPIC30F Motor Control PWM
dsPIC Timers
Asynchronous Stimulus
dsPIC30F Addressing Modes - Part 2
dsPIC30F Architecture - Part 2
dsPIC30F 12-bit ADC Part 1
標(biāo)準(zhǔn)包裝： 160
系列： dsPIC™ 30F
核心處理器： dsPIC
芯體尺寸： 16-位
速度： 30 MIP
連通性： CAN，I²C，SPI，UART/USART
外圍設(shè)備： 高級(jí)欠壓探測/復(fù)位，電機(jī)控制 PWM，QEI，POR，PWM，WDT
輸入/輸出數(shù)： 52
程序存儲(chǔ)器容量： 66KB（22K x 24）
程序存儲(chǔ)器類型： 閃存
EEPROM 大?。?/td> 1K x 8
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 16x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-TQFP
包裝： 托盤
產(chǎn)品目錄頁面： 651 (CN2011-ZH PDF)
配用： XLT64PT5-ND - SOCKET TRAN ICE 64MQFP/TQFP
AC164319-ND - MODULE SKT MPLAB PM3 64TQFP
DV164005-ND - KIT ICD2 SIMPLE SUIT W/USB CABLE
其它名稱： DSPIC30F501530IPT
2008 Microchip Technology Inc.
DS70149D-page 101
dsPIC30F5015/5016
FIGURE 15-4:
DEAD-TIME TIMING DIAGRAM
15.8
Independent PWM Output
An Independent PWM Output mode is required for
driving certain types of loads. A particular PWM output
pair is in the Independent Output mode when the
corresponding PMOD bit in the PWMCON1 register is
set. No dead-time control is implemented between
adjacent PWM I/O pins when the module is operating
in the Independent mode and both I/O pins are allowed
to be active simultaneously.
In the Independent mode, each duty cycle generator is
connected to both of the PWM I/O pins in an output
pair. By using the associated Duty Cycle register and
the appropriate bits in the OVDCON register, the user
may select the following signal output options for each
PWM I/O pin operating in the Independent mode:
I/O pin outputs PWM signal
I/O pin inactive
I/O pin active
15.9
Single-Pulse PWM Operation
The PWM module produces single-pulse outputs when
the PTCON control bits PTMOD<1:0> = 10. Only
edge-aligned outputs may be produced in the
Single-Pulse mode. In Single-Pulse mode, the PWM
I/O pin(s) are driven to the active state when the PTEN
bit is set. When a match with a Duty Cycle register
occurs, the PWM I/O pin is driven to the inactive state.
When a match with the PTPER register occurs, the
PTMR register is cleared, all active PWM I/O pins are
driven to the inactive state, the PTEN bit is cleared and
an interrupt is generated.
15.10 PWM Output Override
The PWM output override bits allow the user to
manually drive the PWM I/O pins to specified logic
states, independent of the duty cycle comparison units.
All control bits associated with the PWM output
override function are contained in the OVDCON
register. The upper half of the OVDCON register
contains eight bits, POVDxH<4:1> and POVDxL<4:1>,
that determine which PWM I/O pins will be overridden.
The lower half of the OVDCON register contains eight
bits, POUTxH<4:1> and POUTxL<4:1>, that determine
the state of the PWM I/O pins when a particular output
is overridden via the POVD bits.
15.10.1
COMPLEMENTARY OUTPUT MODE
When a PWMxL pin is driven active via the OVDCON
register, the output signal is forced to be the
complement of the corresponding PWMxH pin in the
pair. Dead-time insertion is still performed when PWM
channels are overridden manually.
15.10.2
OVERRIDE SYNCHRONIZATION
If the OSYNC bit in the PWMCON2 register is set, all
output overrides performed via the OVDCON register
are synchronized to the PWM time base. Synchronous
output overrides occur at the following times:
Edge-Aligned mode, when PTMR is zero.
Center-Aligned modes, when PTMR is zero and
when the value of PTMR matches PTPER.
Duty Cycle Generator
PWMxH
PWMxL
Time selected by DTSxA bit (A or B)
Time selected by DTSxI bit (A or B)
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PDF描述
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