參數(shù)資料
型號： DSPIC33EP64MC504-E/TL
廠商： Microchip Technology
文件頁數(shù)： 11/412頁
文件大?。?/td> 0K
描述： IC DSC 16BIT 64KB FLASH 44-VTLA
標準包裝： 61
系列： dsPIC™ 33EP
核心處理器： dsPIC
芯體尺寸： 16-位
速度： 60 MIPs
連通性： CAN，I²C，IrDA，LIN，QEI，SPI，UART/USART
外圍設(shè)備： 欠壓檢測/復(fù)位，DMA，電機控制 PWM，POR，PWM，WDT
輸入/輸出數(shù)： 35
程序存儲器容量： 64KB（22K x 24）
程序存儲器類型： 閃存
RAM 容量： 4K x 16
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 9x10b/12b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 44-VFTLA 裸露焊盤
包裝： 管件
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dsPIC33EPXXXGP50X, dsPIC33EPXXXMC20X/50X, AND PIC24EPXXXGP/MC20X
DS70657E-page 108
Preliminary
2011-2012 Microchip Technology Inc.
4.4.3
DATA MEMORY ARBITRATION AND
BUS MASTER PRIORITY
EDS accesses from bus masters in the system are
arbitrated.
The arbiter for data memory (including EDS) arbitrates
between the CPU, the DMA, and the ICD module. In
the event of coincidental access to a bus by the bus
masters, the arbiter determines which bus master
access has the highest priority. The other bus masters
are suspended and processed after the access of the
bus by the bus master with the highest priority.
By default, the CPU is bus master 0 (M0) with the
highest priority, and the ICD is bus master 4 (M4) with
the lowest priority. The remaining bus master (DMA
controller) is allocated to M3, (M1 and M2 are reserved
and cannot be used). The user application may raise or
lower the priority of the DMA controller to be above that
of the CPU by setting the appropriate bits in the EDS
Bus Master Priority Control (MSTRPR) register. All bus
masters with raised priorities will maintain the same
priority relationship relative to each other (i.e., M1
being highest and M3 being lowest with M2 in
between). Also, all the bus masters with priorities below
that of the CPU maintain the same priority relationship
relative to each other. The priority schemes for bus
masters with different MSTRPR values are tabulated in
This bus master priority control allows the user
application to manipulate the real-time response of the
system, either statically during initialization, or
dynamically in response to real-time events.
TABLE 4-62:
DATA MEMORY BUS
ARBITER PRIORITY
FIGURE 4-18:
ARBITER ARCHITECTURE
Priority
MSTRPR<15:0> Bit Setting(1)
0x0000
0x0020
M0 (highest)
CPU
DMA
M1
Reserved
CPU
M2
Reserved
M3
DMA
Reserved
M4 (lowest)
ICD
Note 1: All other values of MSTRPR<15:0> are
Reserved.
ICD
Reserved
Data Memory Arbiter
M0
M1
M2
M3
M4
MSTRPR<15:0>
DMA
CPU
SRAM
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PDF描述
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dsPIC33EP64MC504-I/TL 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC 16b DSC 64KB FL 8KBR 60MHz 44P MCPWMQEI RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
dsPIC33EP64MC504T-E/ML 功能描述:數(shù)字信號處理器和控制器 - DSP, DSC 64KB FL 8KB RAM 60MHz 44Pin RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT
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