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參數(shù)資料
| 型號(hào)： | EFM32TG110F4 |
| 廠商： | Energy Micro |
| 文件頁(yè)數(shù)： | 469/526頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | MCU 32BIT 4KB FLASH 24-QFN |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | Tiny Gecko |
| 核心處理器： | ARM? Cortex?-M3 |
| 芯體尺寸： | 32-位 |
| 速度： | 32MHz |
| 連通性： | EBI/EMI，I²C，IrDA，智能卡，SPI，UART/USART |
| 外圍設(shè)備： | 欠壓檢測(cè)/復(fù)位，DMA，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 17 |
| 程序存儲(chǔ)器容量： | 4KB（4K x 8） |
| 程序存儲(chǔ)器類型： | 閃存 |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 1.8 V ~ 3.8 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 2x12b，D/A 1x12b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 24-VQFN 裸露焊盤 |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | EFM32TG110F4-QFN24 |
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Preliminary
...the world's most energy friendly microcontrollers
2011-05-19 - d0034_Rev0.91
520
www.energymicro.com
16.7. LEUART - NRZ vs. RZI ...................................................................................................................... 231
17.1. TIMER Block Overview ....................................................................................................................... 248
17.2. TIMER Hardware Timer/Counter Control ................................................................................................ 249
17.3. TIMER Clock Selection ....................................................................................................................... 249
17.4. TIMER Connections ........................................................................................................................... 250
17.5. TIMER TOP Value Update Functionality ................................................................................................. 250
17.6. TIMER Quadrature Encoded Inputs ....................................................................................................... 251
17.7. TIMER Quadrature Decoder Configuration .............................................................................................. 251
17.8. TIMER X2 Decoding Mode .................................................................................................................. 252
17.9. TIMER X4 Decoding Mode .................................................................................................................. 252
17.10. TIMER Input Pin Logic ...................................................................................................................... 253
17.11. TIMER Input Capture Buffer Functionality ............................................................................................. 253
17.12. TIMER Output Compare/PWM Buffer Functionality ................................................................................. 254
17.13. TIMER Input Capture ........................................................................................................................ 254
17.14. TIMER Period and/or Pulse width Capture ............................................................................................ 255
17.15. TIMER Block Diagram Showing Comparison Functionality ........................................................................ 255
17.16. TIMER Output Logic ......................................................................................................................... 256
17.17. TIMER Up-count Frequency Generation ............................................................................................... 256
17.18. TIMER Up-count PWM Generation ...................................................................................................... 256
17.19. TIMER CC out in 2x mode ................................................................................................................ 257
17.20. TIMER Up/Down-count PWM Generation .............................................................................................. 258
17.21. TIMER CC out in 2x mode ................................................................................................................ 258
18.1. RTC Overview ................................................................................................................................... 274
19.1. LETIMER Overview ............................................................................................................................ 283
19.2. LETIMER State Machine for Free-running Mode ...................................................................................... 285
19.3. LETIMER One-shot Repeat State Machine ............................................................................................. 286
19.4. LETIMER Buffered Repeat State Machine .............................................................................................. 287
19.5. LETIMER Double Repeat State Machine ................................................................................................ 288
19.6. LETIMER Simple Waveforms Output ..................................................................................................... 290
19.7. LETIMER Repeated Counting .............................................................................................................. 290
19.8. LETIMER Dual Output ........................................................................................................................ 290
19.9. LETIMER Triggered Operation ............................................................................................................. 291
19.10. LETIMER Continuous Operation ......................................................................................................... 292
19.11. LETIMER LETIMERn_CNT Not Initialized to 0 ....................................................................................... 293
20.1. PCNT Overview ................................................................................................................................. 305
20.2. PCNT Quadrature Coding ................................................................................................................... 306
20.3. PCNT Direction Change Interrupt (DIRCNG) Generation ........................................................................... 309
21.1. LESENSE block diagram ..................................................................................................................... 320
21.2. Scan sequence ................................................................................................................................. 322
21.3. Timing diagram, short excitation ........................................................................................................... 322
21.4. Pin sequencing .................................................................................................................................. 324
21.5. Scan result and interrupt generation ...................................................................................................... 325
21.6. Sensor scan and decode sequence ...................................................................................................... 325
21.7. Decoder state transition evaluation ........................................................................................................ 326
21.8. Decoder hysteresis ............................................................................................................................ 327
21.9. Circular result buffer ........................................................................................................................... 328
21.10. Capacitive sense setup ..................................................................................................................... 330
21.11. LC sensor setup .............................................................................................................................. 330
21.12. LC sensor oscillations ....................................................................................................................... 331
21.13. FSM example 1 ............................................................................................................................... 331
21.14. FSM example 2 ............................................................................................................................... 332
22.1. ACMP Overview ................................................................................................................................ 366
22.2. 20 mV Hysteresis Selected .................................................................................................................. 368
22.3. Capacitive Sensing Set-up ................................................................................................................... 369
23.1. VCMP Overview ................................................................................................................................ 377
23.2. VCMP 20 mV Hysteresis Enabled ......................................................................................................... 378
24.1. ADC Overview .................................................................................................................................. 386
24.2. ADC Conversion Timing ...................................................................................................................... 387
24.3. ADC Analog Power Consumption With Different WARMUPMODE Settings .................................................... 388
24.4. ADC RC Input Filter Configuration ........................................................................................................ 388
24.5. ADC Bias Programming ...................................................................................................................... 390
24.6. ADC Conversion Tailgating .................................................................................................................. 391
25.1. DAC Overview .................................................................................................................................. 409
25.2. DAC Bias Programming ...................................................................................................................... 411
25.3. DAC Sine Mode ................................................................................................................................ 412
26.1. OPAMP System Overview ................................................................................................................... 430
26.2. OPAMP Overview .............................................................................................................................. 431
26.3. Voltage Follower Unity Gain Overview ................................................................................................... 433
26.4. Inverting input PGA Overview .............................................................................................................. 433
26.5. Non-inverting PGA Overview ................................................................................................................ 434
26.6. Cascaded Inverting PGA Overview ....................................................................................................... 434
26.7. Cascaded Non-inverting PGA Overview ................................................................................................. 435
26.8. Two Op-amp Differential Amplifier Overview ........................................................................................... 436
26.9. Three Op-amp Differential Amplifier Overview ......................................................................................... 437
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