參數(shù)資料
型號(hào)： EP1SGX25DF672C5N
廠商： Altera
文件頁(yè)數(shù)： 10/1456頁(yè)
文件大?。?/td> 0K
描述： IC STRATIX GX FPGA 25K 672-FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 20
系列： Stratix® GX
LAB/CLB數(shù)： 2566
邏輯元件/單元數(shù)： 25660
RAM 位總計(jì)： 1944576
輸入/輸出數(shù)： 455
電源電壓： 1.425 V ~ 1.575 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 672-BBGA
供應(yīng)商設(shè)備封裝： 672-BGA（27x27）
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14–18
Altera Corporation
Stratix GX Device Handbook, Volume 2
July 2005
Clock Modes
Input/Output Clock Mode
The TriMatrix memory blocks can implement input/output clock mode
for true and simple dual-port memory. On each of the two ports, A and B,
one clock controls all registers for inputs into the memory block: data
input, wren, and address. The other clock controls the block’s data output
registers. Each memory block port also supports independent clock
enables and asynchronous clear signals for input and output registers.
Figures 14–10 and 14–11 show the memory block in input/output clock
mode for true and simple dual-port modes, respectively.
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