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參數(shù)資料
| 型號： | EP20K100TC144-3 |
| 英文描述： | Field Programmable Gate Array (FPGA) |
| 中文描述： | 現(xiàn)場可編程門陣列（FPGA） |
| 文件頁數(shù)： | 110/114頁 |
| 文件大?。?/td> | 1623K |
| 代理商： | EP20K100TC144-3 |
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Altera Corporation
95
APEX 20K Programmable Logic Device Family Data Sheet
ESB Timing Microparameters, fMAX Routing Delays, Minimum Pulse
Width Timing Parameters, External Timing Parameters, and External
Bidirectional Timing Parameters for EP20K200E APEX 20KE devices.
Table 76. EP20K160E External Bidirectional Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSUBIDIR
2.86
3.24
3.54
ns
tINHBIDIR
0.00
ns
tOUTCOBIDIR
2.00
5.07
2.00
5.59
2.00
6.13
ns
tXZBIDIR
7.43
8.23
8.58
ns
tZXBIDIR
7.43
8.23
8.58
ns
tINSUBIDIRPLL
4.93
5.48
-
ns
tINHBIDIRPLL
0.00
-
ns
tOUTCOBIDIRPLL
0.50
3.00
0.50
3.35
-
ns
tXZBIDIRPLL
5.36
5.99
-
ns
tZXBIDIRPLL
5.36
5.99
-
ns
Table 77. EP20K200E fMAX LE Timing Microparameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tSU
0.23
0.24
0.26
ns
tH
0.23
0.24
0.26
ns
tCO
0.26
0.31
0.36
ns
tLUT
0.70
0.90
1.14
ns
相關PDF資料 |
PDF描述 |
|---|---|
| EP20K100TC144-3ES | FPGA |
| EP20K100TI144-1 | Field Programmable Gate Array (FPGA) |
| EP20K100TI144-1ES | FPGA |
| EP20K100TI144-2 | Field Programmable Gate Array (FPGA) |
| EP20K100TI144-2ES | FPGA |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| EP20K100TC144-3ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K100TC144-3N | 功能描述:FPGA - 現(xiàn)場可編程門陣列 CPLD - APEX 20K 416 Macro 101 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP20K100TC144-3V | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| EP20K100TI144-1 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Field Programmable Gate Array (FPGA) |
| EP20K100TI144-1ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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