參數資料
| 型號： | EP20K160EFC484-1N |
| 廠商： | Altera |
| 文件頁數： | 92/117頁 |
| 文件大小： | 0K |
| 描述： | IC APEX 20KE FPGA 160K 484-FBGA |
| 產品培訓模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標準包裝： | 60 |
| 系列： | APEX-20K® |
| LAB/CLB數： | 640 |
| 邏輯元件/單元數： | 6400 |
| RAM 位總計： | 81920 |
| 輸入/輸出數： | 316 |
| 門數： | 404000 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 484-BGA |
| 供應商設備封裝： | 484-FBGA（23x23） |
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Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
(1)
These timing parameters are sample-tested only.
Table 39. APEX 20KE External Bidirectional Timing Parameters
Symbol
Parameter
Conditions
tINSUBIDIR
Setup time for bidirectional pins with global clock at LAB adjacent Input
Register
tINHBIDIR
Hold time for bidirectional pins with global clock at LAB adjacent Input
Register
tOUTCOBIDIR
Clock-to-output delay for bidirectional pins with global clock at IOE output
register
C1 = 10 pF
tXZBIDIR
Synchronous Output Enable Register to output buffer disable delay
C1 = 10 pF
tZXBIDIR
Synchronous Output Enable Register output buffer enable delay
C1 = 10 pF
tINSUBIDIRPLL
Setup time for bidirectional pins with PLL clock at LAB adjacent Input
Register
tINHBIDIRPLL
Hold time for bidirectional pins with PLL clock at LAB adjacent Input
Register
tOUTCOBIDIRPLL
Clock-to-output delay for bidirectional pins with PLL clock at IOE output
register
C1 = 10 pF
tXZBIDIRPLL
Synchronous Output Enable Register to output buffer disable delay with
PLL
C1 = 10 pF
tZXBIDIRPLL
Synchronous Output Enable Register output buffer enable delay with PLL
C1 = 10 pF
相關PDF資料 |
PDF描述 |
|---|---|
| IDT71V416S15PHGI | IC SRAM 4MBIT 15NS 44TSOP |
| EP20K160EFC484-1 | IC APEX 20KE FPGA 160K 484-FBGA |
| A54SX32-2BG313I | IC FPGA SX 48K GATES 313-BGA |
| RSC60DRTF | CONN EDGECARD 120PS DIP .100 SLD |
| A42MX36-1PQ240 | IC FPGA MX SGL CHIP 54K 240-PQFP |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| EP20K160EFC484-2 | 功能描述:FPGA - 現場可編程門陣列 CPLD - APEX 20K 640 Macro 316 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數量: 邏輯塊數量:943 內嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風格:SMD/SMT 封裝 / 箱體:FBGA-256 |
| EP20K160EFC484-2ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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