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參數(shù)資料
| 型號： | EP20K200EQC240-3N |
| 廠商： | Altera |
| 文件頁數(shù)： | 108/117頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC APEX 20KE FPGA 200K 240-PQFP |
| 產(chǎn)品培訓(xùn)模塊： | Three Reasons to Use FPGA's in Industrial Designs |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | APEX-20K® |
| LAB/CLB數(shù)： | 832 |
| 邏輯元件/單元數(shù)： | 8320 |
| RAM 位總計： | 106496 |
| 輸入/輸出數(shù)： | 168 |
| 門數(shù)： | 404000 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 240-BFQFP |
| 供應(yīng)商設(shè)備封裝： | 240-PQFP（32x32） |
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90
Altera Corporation
APEX 20K Programmable Logic Device Family Data Sheet
Table 64. EP20K100E Minimum Pulse Width Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tCH
2.00
ns
tCL
2.00
ns
tCLRP
0.20
ns
tPREP
0.20
ns
tESBCH
2.00
ns
tESBCL
2.00
ns
tESBWP
1.29
1.53
1.66
ns
tESBRP
1.11
1.29
1.41
ns
Table 65. EP20K100E External Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSU
2.23
2.32
2.43
ns
tINH
0.00
ns
tOUTC O
2.00
4.86
2.00
5.35
2.00
5.84
ns
tINSUP L L
1.58
1.66
-
ns
tINHPL L
0.00
-
ns
tOUTC OPLL
0.50
2.96
0.50
3.29
-
ns
Table 66. EP20K100E External Bidirectional Timing Parameters
Symbol
-1
-2
-3
Unit
Min
Max
Min
Max
Min
Max
tINSUB I DIR
2.74
2.96
3.19
ns
tINHBIDIR
0.00
ns
tOUTC OBIDIR
2.00
4.86
2.00
5.35
2.00
5.84
ns
tXZB I DIR
5.00
5.48
5.89
ns
tZXB I DIR
5.00
5.48
5.89
ns
tINSUB I DIRPL L
4.64
5.03
-
ns
tINHBIDIRP L L
0.00
-
ns
tOUTC OBIDIRP L L
0.50
2.96
0.50
3.29
-
ns
tXZB I DIRPL L
3.10
3.42
-
ns
tZXB I DIRPL L
3.10
3.42
-
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| EP20K200EQC240-3 | IC APEX 20KE FPGA 200K 240-PQFP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| EP20K200EQI208-1 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K200EQI208-1ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K200EQI208-1X | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K200EQI208-2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| EP20K200EQI208-2ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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