參數(shù)資料
型號(hào)： EP2AGX45DF29I3N
廠商： Altera
文件頁(yè)數(shù)： 25/90頁(yè)
文件大?。?/td> 0K
描述： IC ARRIA II GX FPGA 45K 780FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 4
系列： Arria II GX
LAB/CLB數(shù)： 1805
邏輯元件/單元數(shù)： 42959
RAM 位總計(jì)： 3517440
輸入/輸出數(shù)： 364
電源電壓： 0.87 V ~ 0.93 V
安裝類(lèi)型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 780-BBGA
供應(yīng)商設(shè)備封裝： 780-FBGA（29x29）
其它名稱(chēng)： 544-2701
Ch
ap
te
r
1:
De
vice
Da
ta
sh
e
tfo
r
Arria
II
De
vice
s
1–2
3
Switc
h
ing
C
h
ar
acter
istics
Dec
ember
2013
Alte
ra
Cor
p
oration
A
fixedclk
clock
frequency
PCIe
Receiver
Detect
—
125
—
125
—
125
—
125
—
MHz
reconfig_
clk
clock
frequency
Dynamic
reconfig.
clock
frequency
2.5/
37.5
—50
2.5/
37.5
—50
2.5/
37.5
—50
2.5/
37.5
—50
MHz
Delta time
between
reconfig_
clks
——
—
2
—
2
—
2
—
2
ms
Transceiver block
minimum
power-down
pulse width
——
1
—
1
—
1
—
1
—
s
Receiver
Supported I/O
Standards
1.4-V PCML, 1.5-V PCML, 2.5-V PCML, 2.5-V PCML, LVPECL, and LVDS
—
600
—
6375
600
—
3750
600
—
3750
600
—
3125
Mbps
Absolute VMAX
for a receiver pin
—
1.5
—
1.5
—
1.5
—
1.5
V
Absolute VMIN for
a receiver pin
—
-0.4
—
-0.4
—
-0.4
—
-0.4
—
V
Maximum
peak-to-peak
differential input
voltage VID (diff
p-p)
VICM = 0.82 V
setting
—
2.7
—
2.7
—
2.7
—
2.7
V
VICM =1.1 V
setting (7)
—
1.6
—
1.6
—
1.6
—
1.6
V
Table 1–34. Transceiver Specifications for Arria II GX Devices (Note 1) (Part 3 of 7)
Symbol/
Description
Condition
I3
C4
C5 and I5
C6
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
相關(guān)PDF資料
PDF描述
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EP2AGX65CU17C4N 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門(mén)陣列 FPGA - Arria II GX 2530 LABs 156 IOs RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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