參數(shù)資料
型號(hào)： EP2AGX65DF25C5
廠商： Altera
文件頁(yè)數(shù)： 24/90頁(yè)
文件大小： 0K
描述： IC ARRIA II GX FPGA 65K 572FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 5
系列： Arria II GX
LAB/CLB數(shù)： 2530
邏輯元件/單元數(shù)： 60214
RAM 位總計(jì)： 5371904
輸入/輸出數(shù)： 252
電源電壓： 0.87 V ~ 0.93 V
安裝類型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 572-FBGA
供應(yīng)商設(shè)備封裝： 572-FBGA
Ch
ap
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Arria
II
De
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1–2
2
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Dec
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2013
Alte
ra
Cor
p
oration
A
Spread-spectrum
downspread
PCIe
—
0 to
–0.5%
——
0 to
–0.5%
——
0 to
–0.5%
——
0 to
–0.5%
——
On-chip
termination
resistors
—
100
—
100
—
100
—
100
—
VICM
(AC coupled)
—
1100 ± 5%
mV
VICM
(DC coupled)
HCSL I/O
standard for
PCIe
reference
clock
250
—
550
250
—
550
250
—
550
250
—
550
mV
Transmitter
REFCLK Phase
Noise
10 Hz
—
-50
—
-50
—
-50
—
-50
dBc/Hz
100 Hz
—
-80
—
-80
—
-80
—
-80
dBc/Hz
1 KHz
—
-110
—
-110
—
-110
—
-110
dBc/Hz
10 KHz
—
-120
—
-120
—
-120
—
-120
dBc/Hz
100 KHz
—
-120
—
-120
—
-120
—
-120
dBc/Hz
1 MHz
—
-130
—
-130
—
-130
—
-130
dBc/Hz
Transmitter
REFCLK Phase
Jitter (rms) for
100 MHz
REFCLK (3)
10 KHz to
20 MHz
——
3
—
3
—
3
—
3
ps
Rref
——
2000
±1%
——
2000
±1%
——
2000
±1%
——
2000 ±
1%
—
Transceiver Clocks
Calibration block
clock frequency
(cal_blk_clk)
—
10
—
125
10
—
125
10
—
125
10
—
125
MHz
Table 1–34. Transceiver Specifications for Arria II GX Devices (Note 1) (Part 2 of 7)
Symbol/
Description
Condition
I3
C4
C5 and I5
C6
Unit
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
相關(guān)PDF資料
PDF描述
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