參數(shù)資料
型號(hào)： EP4S100G5F45I3
廠商： Altera
文件頁(yè)數(shù)： 7/22頁(yè)
文件大小： 0K
描述： IC STRATIX IV FPGA 530K 1932FBGA
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 3
系列： STRATIX® IV GT
LAB/CLB數(shù)： 21248
邏輯元件/單元數(shù)： 531200
RAM 位總計(jì)： 28033024
輸入/輸出數(shù)： 781
電源電壓： 0.92 V ~ 0.98 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 1932-BBGA
供應(yīng)商設(shè)備封裝： 1932-FBGA（45x45）
Ch
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te
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1:
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1–1
5
Architecture
Features
Septemb
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20
12
Alter
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Co
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o
n
Stra
Volume
Table 1–4 lists the Stratix IV E device features.
Table 1–4. Stratix IV E Device Features
Feature
EP4SE230
EP4SE360
EP4SE530
EP4SE820
Package Pin Count
780
1152
1517
1760
1152
1517
1760
ALMs
91,200
141,440
212,480
325,220
LEs
228,000
353,600
531,200
813,050
High-Speed LVDS
SERDES (up to
1.6 Gbps) (1)
56
88
112
88
112
132
SPI-4.2 Links
3
4
6
4
6
M9K Blocks
(256 x 36 bits)
1,235
1,248
1,280
1610
M144K Blocks
(2048 x 72 bits)
22
48
64
60
Total Memory
(MLAB+M9K+
M144K) Kb
17,133
22,564
27,376
33,294
Embedded Multipliers
(18 x 18) (2)
1,288
1,040
1,024
960
PLLs
4
8
12
8
12
User I/Os (3)
488
744
976
744 (4)
976 (4)
1120 (4)
Speed Grade
(fastest to slowest)
–2, –3, –4
–3, –4
Notes to Table 1–4:
(1) The user I/O count from the pin-out files include all general purpose I/Os, dedicated clock pins, and dual purpose configuration pins. Transceiver pins
and dedicated configuration pins are not included in the pin count.
(2) Four multiplier adder mode.
(3) Total pairs of high-speed LVDS SERDES take the lowest channel count of RX/TX.
(4) This data is preliminary.
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PDF描述
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