參數(shù)資料
型號: EPF10K10TC144-4N
廠商: Altera
文件頁數(shù): 67/128頁
文件大?。?/td> 0K
描述: IC FLEX 10K FPGA 10K 144-TQFP
產(chǎn)品培訓模塊: Three Reasons to Use FPGA's in Industrial Designs
標準包裝: 60
系列: FLEX-10K®
LAB/CLB數(shù): 72
邏輯元件/單元數(shù): 576
RAM 位總計: 6144
輸入/輸出數(shù): 102
門數(shù): 31000
電源電壓: 4.75 V ~ 5.25 V
安裝類型: 表面貼裝
工作溫度: 0°C ~ 85°C
封裝/外殼: 144-LQFP
供應商設備封裝: 144-TQFP(20x20)
其它名稱: 544-2202
Altera Corporation
43
FLEX 10K Embedded Programmable Logic Device Family Data Sheet
Figure 18 shows the timing requirements for the JTAG signals.
Figure 18. JTAG Waveforms
Table 16 shows the timing parameters and values for FLEX 10K devices.
Table 16. JTAG Timing Parameters & Values
Symbol
Parameter
Min
Max
Unit
tJCP
TCK
clock period
100
ns
tJCH
TCK
clock high time
50
ns
tJCL
TCK
clock low time
50
ns
tJPSU
JTAG port setup time
20
ns
tJPH
JTAG port hold time
45
ns
tJPCO
JTAG port clock to output
25
ns
tJPZX
JTAG port high impedance to valid output
25
ns
tJPXZ
JTAG port valid output to high impedance
25
ns
tJSSU
Capture register setup time
20
ns
tJSH
Capture register hold time
45
ns
tJSCO
Update register clock to output
35
ns
tJSZX
Update register high-impedance to valid output
35
ns
tJSXZ
Update register valid output to high impedance
35
ns
TDO
TCK
tJPZX
t
JPCO
tJPH
t JPXZ
tJCP
tJPSU
t JCL
tJCH
TDI
TMS
Signal
to Be
Captured
Signal
to Be
Driven
t
JSZX
tJSSU
tJSH
t
JSCO
tJSXZ
相關PDF資料
PDF描述
ATFC-0402-2N5-BT INDUCTOR THIN FILM 2.5NH 0402
TLJS686M004R1500 CAP TANT 68UF 4V 20% 1206
GSC50DRSD-S273 CONN EDGECARD 100PS DIP .100 SLD
VJ1206A750KBEAT4X CAP CER 75PF 500V 10% NP0 1206
VJ1206A820JBAAT4X CAP CER 82PF 50V 5% NP0 1206
相關代理商/技術參數(shù)
參數(shù)描述
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