參數(shù)資料
型號(hào)： EPF10K10TC144-4N
廠商： Altera
文件頁(yè)數(shù)： 87/128頁(yè)
文件大?。?/td> 0K
描述： IC FLEX 10K FPGA 10K 144-TQFP
產(chǎn)品培訓(xùn)模塊： Three Reasons to Use FPGA's in Industrial Designs
標(biāo)準(zhǔn)包裝： 60
系列： FLEX-10K®
LAB/CLB數(shù)： 72
邏輯元件/單元數(shù)： 576
RAM 位總計(jì)： 6144
輸入/輸出數(shù)： 102
門(mén)數(shù)： 31000
電源電壓： 4.75 V ~ 5.25 V
安裝類(lèi)型： 表面貼裝
工作溫度： 0°C ~ 85°C
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-TQFP（20x20）
其它名稱： 544-2202
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Altera Corporation
61
FLEX 10K Embedded Programmable Logic Device Family Data Sheet
Table 34. EAB Timing Microparameters
Symbol
Parameter
Conditions
tEABDATA1
Data or address delay to EAB for combinatorial input
tEABDATA2
Data or address delay to EAB for registered input
tEABWE1
Write enable delay to EAB for combinatorial input
tEABWE2
Write enable delay to EAB for registered input
tEABCLK
EAB register clock delay
tEABCO
EAB register clock-to-output delay
tEABBYPASS
Bypass register delay
tEABSU
EAB register setup time before clock
tEABH
EAB register hold time after clock
tAA
Address access delay
tWP
Write pulse width
tWDSU
Data setup time before falling edge of write pulse
tWDH
Data hold time after falling edge of write pulse
tWASU
Address setup time before rising edge of write pulse
tWAH
Address hold time after falling edge of write pulse
tWO
Write enable to data output valid delay
tDD
Data-in to data-out valid delay
tEABOUT
Data-out delay
tEABCH
Clock high time
tEABCL
Clock low time
相關(guān)PDF資料
PDF描述
ATFC-0402-2N5-BT INDUCTOR THIN FILM 2.5NH 0402
TLJS686M004R1500 CAP TANT 68UF 4V 20% 1206
GSC50DRSD-S273 CONN EDGECARD 100PS DIP .100 SLD
VJ1206A750KBEAT4X CAP CER 75PF 500V 10% NP0 1206
VJ1206A820JBAAT4X CAP CER 82PF 50V 5% NP0 1206
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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