fACNT Maximum internal array" />
參數(shù)資料
型號(hào)： EPM7128STC100-10N
廠商： Altera
文件頁(yè)數(shù)： 35/66頁(yè)
文件大?。?/td> 0K
描述： IC MAX 7000 CPLD 128 100-TQFP
標(biāo)準(zhǔn)包裝： 270
系列： MAX® 7000
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1)： 10.0ns
電壓電源 - 內(nèi)部： 4.75 V ~ 5.25 V
邏輯元件/邏輯塊數(shù)目： 8
宏單元數(shù)： 128
門數(shù)： 2500
輸入/輸出數(shù)： 84
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 100-TQFP
供應(yīng)商設(shè)備封裝： 100-TQFP（14x14）
包裝： 托盤
產(chǎn)品目錄頁(yè)面： 604 (CN2011-ZH PDF)
其它名稱： 544-2045
EPM7128STC100-10N-ND
40
Altera Corporation
MAX 7000 Programmable Logic Device Family Data Sheet
fACNT
Maximum internal array clock
frequency
175.4
142.9
116.3
100.0
MHz
fMAX
Maximum clock frequency
250.0
200.0
166.7
125.0
MHz
Table 28. EPM7032S Internal Timing Parameters
Symbol
Parameter
Conditions
Speed Grade
Unit
-5
-6
-7
-10
Min
Max
Min
Max
Min
Max
Min
Max
tIN
Input pad and buffer delay
0.2
0.3
0.5
ns
tIO
I/O input pad and buffer delay
0.2
0.3
0.5
ns
tFIN
Fast input delay
2.2
2.1
2.5
1.0
ns
tSEXP
Shared expander delay
3.1
3.8
4.6
5.0
ns
tPEXP
Parallel expander delay
0.9
1.1
1.4
0.8
ns
tLAD
Logic array delay
2.6
3.3
4.0
5.0
ns
tLAC
Logic control array delay
2.5
3.3
4.0
5.0
ns
tIOE
Internal output enable delay
0.7
0.8
1.0
2.0
ns
tOD1
Output buffer and pad delay
C1 = 35 pF
0.2
0.3
0.4
1.5
ns
tOD2
Output buffer and pad delay
C1 = 35 pF (6)
0.7
0.8
0.9
2.0
ns
tOD3
Output buffer and pad delay
C1 = 35 pF
5.2
5.3
5.4
5.5
ns
tZX1
Output buffer enable delay
C1 = 35 pF
4.0
5.0
ns
tZX2
Output buffer enable delay
C1 = 35 pF (6)
4.5
5.5
ns
tZX3
Output buffer enable delay
C1 = 35 pF
9.0
ns
tXZ
Output buffer disable delay
C1 = 5 pF
4.0
5.0
ns
tSU
Register setup time
0.8
1.0
1.3
2.0
ns
tH
Register hold time
1.7
2.0
2.5
3.0
ns
tFSU
Register setup time of fast
input
1.9
1.8
1.7
3.0
ns
tFH
Register hold time of fast
input
0.6
0.7
0.8
0.5
ns
tRD
Register delay
1.2
1.6
1.9
2.0
ns
tCOMB
Combinatorial delay
0.9
1.1
1.4
2.0
ns
tIC
Array clock delay
2.7
3.4
4.2
5.0
ns
tEN
Register enable time
2.6
3.3
4.0
5.0
ns
tGLOB
Global control delay
1.6
1.4
1.7
1.0
ns
tPRE
Register preset time
2.0
2.4
3.0
ns
tCLR
Register clear time
2.0
2.4
3.0
ns
Table 27. EPM7032S External Timing Parameters (Part 2 of 2)
Note (1)
Symbol
Parameter
Conditions
Speed Grade
Unit
-5
-6
-7
-10
MinMax
相關(guān)PDF資料
PDF描述
ISPLSI 1032EA-100LT100 IC PLD ISP 64I/O 10NS 100TQFP
VI-27N-CY-F3 CONVERTER MOD DC/DC 18.5V 50W
TAP104K050CRW CAP TANT 0.1UF 50V 10% RADIAL
RW2-0515S/H2 CONV DC/DC 2W 4.5-9VIN 15VOUT
VI-J1F-CW-B1 CONVERTER MOD DC/DC 72V 100W
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
EPM7128STC10015 制造商:Altera Corporation 功能描述:
EPM7128STC100-15 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 128 Macro 84 IOs RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
EPM7128STC100-15F 功能描述:IC MAX 7000 CPLD 128 100-TQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - CPLD（復(fù)雜可編程邏輯器件） 系列:MAX® 7000 標(biāo)準(zhǔn)包裝:24 系列:CoolRunner II 可編程類型:系統(tǒng)內(nèi)可編程 最大延遲時(shí)間 tpd(1):7.1ns 電壓電源 - 內(nèi)部:1.7 V ~ 1.9 V 邏輯元件/邏輯塊數(shù)目:24 宏單元數(shù):384 門數(shù):9000 輸入/輸出數(shù):173 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:208-BFQFP 供應(yīng)商設(shè)備封裝:208-PQFP（28x28） 包裝:托盤
EPM7128STC100-15N 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 128 Macro 84 IOs RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
EPM7128STC100-6 功能描述:CPLD - 復(fù)雜可編程邏輯器件 CPLD - MAX 7000 128 Macro 84 IOs RoHS:否 制造商:Lattice 系列: 存儲(chǔ)類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時(shí)間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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