參數(shù)資料
型號(hào): EPM7256SRI208-10N
廠商: Altera
文件頁(yè)數(shù): 24/66頁(yè)
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描述: IC MAX 7000 CPLD 256 208-RQFP
產(chǎn)品變化通告: Package Change 30/Jun/2010
標(biāo)準(zhǔn)包裝: 24
系列: MAX® 7000
可編程類(lèi)型: 系統(tǒng)內(nèi)可編程
最大延遲時(shí)間 tpd(1): 10.0ns
電壓電源 - 內(nèi)部: 4.5 V ~ 5.5 V
邏輯元件/邏輯塊數(shù)目: 16
宏單元數(shù): 256
門(mén)數(shù): 5000
輸入/輸出數(shù): 164
工作溫度: -40°C ~ 85°C
安裝類(lèi)型: 表面貼裝
封裝/外殼: 208-BFQFP 裸露焊盤(pán)
供應(yīng)商設(shè)備封裝: 208-RQFP(28x28)
包裝: 托盤(pán)
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Altera Corporation
MAX 7000 Programmable Logic Device Family Data Sheet
Figure 13. Switching Waveforms
Combinatorial Mode
Input Pin
I/O Pin
PIA Delay
Shared Expander
Delay
Logic Array
Input
Parallel Expander
Delay
Logic Array
Output
Output Pin
tIN
tLAC , tLAD
tPIA
tOD
tPEXP
tIO
tSEXP
tCOMB
Global Clock Mode
Global
Clock Pin
Global Clock
at Register
Data or Enable
(Logic Array Output)
tF
tCH
tCL
tR
tIN
tGLOB
tSU
tH
Array Clock Mode
Input or I/O Pin
Clock into PIA
Clock into
Logic Array
Clock at
Register
Data from
Logic Array
Register to PIA
to Logic Array
Register Output
to Pin
tF
tR
tACH
tACL
tSU
tIN
tIO
tRD
tPIA
tCLR , tPRE
tH
tPIA
tIC
tPIA
tOD
tR & tF < 3 ns.
Inputs are driven at 3 V
for a logic high and 0 V
for a logic low. All timing
characteristics are
measured at 1.5 V.
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PDF描述
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