參數(shù)資料
型號： EVAL-AD7641CBZ
廠商： Analog Devices Inc
文件頁數(shù)： 25/28頁
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描述： BOARD EVALUATION FOR AD7641
產(chǎn)品培訓(xùn)模塊： ADC Applications
ADC Architectures
ADC DC/AC Performance
標(biāo)準(zhǔn)包裝： 1
系列： PulSAR®
ADC 的數(shù)量： 1
位數(shù)： 18
采樣率（每秒）： 2M
數(shù)據(jù)接口： 串行
輸入范圍： ±2.5 V
在以下條件下的電源（標(biāo)準(zhǔn)）： 2MSPS 帶內(nèi)部基準(zhǔn)時為 75mW
工作溫度： -40°C ~ 85°C
已用 IC / 零件： AD7641
已供物品： 板
相關(guān)產(chǎn)品： AD7641BSTZRL-ND - IC ADC 18BIT 2MSPS SAR 48-LQFP
AD7641BCPZRL-ND - IC ADC 18BIT 2MSPS SAR 48-LFCSP
AD7641BSTZ-ND - IC ADC 18BIT 2MSPS SAR 48-LQFP
AD7641BCPZ-ND - IC ADC 18BIT 2MSPS SAR 48-LFCSP
AD7641
Rev. 0 | Page 6 of 28
Table 4. Serial Clock Timings in Master Read After Convert Mode
DIVSCLK[1]
0
1
DIVSCLK[0]
Symbol
0
1
0
1
Unit
SYNC to SCLK First Edge Delay Minimum
t18
0.5
3
ns
Internal SCLK Period Minimum
t19
8
16
32
64
ns
Internal SCLK Period Maximum
t19
26
52
103
ns
Internal SCLK High Minimum
t20
2
6
15
31
ns
Internal SCLK Low Minimum
t21
3
7
16
32
ns
SDOUT Valid Setup Time Minimum
t22
1
5
ns
SDOUT Valid Hold Time Minimum
t23
0
0.5
10
28
ns
SCLK Last Edge to SYNC Delay Minimum
t24
0
0.5
9
26
ns
BUSY High Width Maximum
t24
0.630
0.870
1.350
2.28
μs
04
76
1-
00
2
NOTE
IN SERIAL INTERFACE MODES, THE SYNC, SCLK, AND
SDOUT TIMING ARE DEFINED WITH A MAXIMUM LOAD
CL OF 10pF; OTHERWISE, THE LOAD IS 60pF MAXIMUM.
500AIOL
500AIOH
1.4V
TO OUTPUT
PIN
CL
50pF
Figure 2. Load Circuit for Digital Interface Timing,
SDOUT, SYNC, and SCLK Outputs, CL = 10 pF
0.8V
2V
0.8V
2V
tDELAY
0
476
1-
00
3
Figure 3. Voltage Reference Levels for Timing
相關(guān)PDF資料
PDF描述
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DC1571A-A BOARD SAR ADC LTC2383-16
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EVAL-AD7612CBZ BOARD EVALUATION FOR AD7612
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參數(shù)描述
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EVAL-AD7643CB 制造商:Analog Devices 功能描述:EVAL BD FOR AD7643 - Bulk
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EVAL-AD7650CB 制造商:Analog Devices 功能描述:EVAL BD EVAL BD AD765X/AD766X/AD767X - Bulk
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