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參數(shù)資料
| 型號： | GS88136BT-200 |
| 廠商： | GSI TECHNOLOGY |
| 元件分類： | DRAM |
| 英文描述： | 512K x 18, 256K x 32, 256K x 36 9Mb Sync Burst SRAMs |
| 中文描述： | 256K X 36 CACHE SRAM, 6.5 ns, PQFP100 |
| 封裝： | TQFP-100 |
| 文件頁數(shù)： | 26/39頁 |
| 文件大?。?/td> | 791K |
| 代理商： | GS88136BT-200 |
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Instruction Register
ID Code Register
·
31 30 29
Boundary Scan Register
0
1
2
0
· · ·
1
2
0
Bypass Register
TDI
TDO
TMS
TCK
Test Access Port (TAP) Controller
1
·
1
0
·
·
·
·
·
·
·
·
·
Control Signals
·
GS88118B(T/D)/GS88132B(T/D)/GS88136B(T/D)
Rev: 1.05 11/2005
Specifications cited are subject to change without notice. For latest documentation see http://www.gsitechnology.com.
26/39
2002, GSI Technology
JTAG TAP Block Diagram
Identification (ID) Register
The ID Register is a 32-bit register that is loaded with a device and vendor specific 32-bit code when the controller is put in
Capture-DR state with the IDCODE command loaded in the Instruction Register. The code is loaded from a 32-bit on-chip ROM.
It describes various attributes of the RAM as indicated below. The register is then placed between the TDI and TDO pins when the
controller is moved into Shift-DR state. Bit 0 in the register is the LSB and the first to reach TDO when shifting begins.
相關(guān)PDF資料 |
PDF描述 |
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| GS88136BT-250I | 512K x 18, 256K x 32, 256K x 36 9Mb Sync Burst SRAMs |
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| GS88136BT-300I | 512K x 18, 256K x 32, 256K x 36 9Mb Sync Burst SRAMs |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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