參數(shù)資料
型號: HM5257165B-A6
廠商: Elpida Memory, Inc.
英文描述: CABLE ASSEMBLY
中文描述: 512M LVTTL接口SDRAM的133 MHz/100 MHz的8 Mword】16位】4-bank/16-Mword】8位】4銀行/ 32 Mword】4位】4銀行PC/133,電腦/ 100內(nèi)存
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代理商: HM5257165B-A6
HM5257165B/HM5257805B/HM5257405B-75/A6
Data Sheet E0081H10
50
Notes: 1. AC measurement assumes t
T
= 1 ns. Reference level for timing of input signals is 1.5 V.
2. Access time is measured at 1.5 V. Load condition is CL = 50 pF.
3. t
LZ
(min) defines the time at which the outputs achieves the low impedance state.
4. t
HZ
(max) defines the time at which the outputs achieves the high impedance state.
5. t
CES
define CKE setup time to CLK rising edge except power down exit command.
6. t
AS
/t
AH
: Address, t
CS
/t
CH
:
CS
,
RAS
,
CAS
,
WE
, DQM, DQMU/DQML.
t
DS
/t
DH
: Data-in, t
CES
/t
CEH
: CKE.
Test Conditions
Input and output timing reference levels: 1.5 V
Input waveform and output load: See following figures
t
T
2.4 V
0.4 V0.8 V
2.0 V
input
t
T
I/O
CL
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PDF描述
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