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參數(shù)資料
| 型號： | HM5425401B |
| 廠商： | Elpida Memory, Inc. |
| 英文描述： | 256M SSTL_2 interface DDR SDRAM 143 MHz/133 MHz/125 MHz/100 MHz 4-Mword 】 16-bit 】 4-bank/8-Mword 】 8-bit 】 4-bank/ 16-Mword 】 4-bit 】 4-bank |
| 中文描述： | 256M SSTL_2 DDR SDRAM的接口143 MHz/133 MHz/125 MHz/100 MHz的4 Mword】16位】4-bank/8-Mword】8位】4銀行/ 16 Mword】4位】4 -銀行 |
| 文件頁數(shù)： | 22/65頁 |
| 文件大?。?/td> | 489K |
| 代理商： | HM5425401B |
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HM5425161B, HM5425801B, HM5425401B Series
Data Sheet E0086H20
22
Mode Register and Extended Mode Register Set
There are two mode registers, the mode register and the extended mode register so as to define the operating
mode. Parameters are set to both through the A0 to the A12 and BA0, BA1 pins by the mode register set
command [MRS] or the extended mode register set command [EMRS]. The mode register and the extended
mode register are set by inputting signal via the A0 to the A12 and BA0, BA1 during mode register set cycles.
BA0 and BA1 determine which one of the mode register or the extended mode register are set. Prior to a read
or a write operation, the mode register must be set.
Remind that no other parameters are shown in the table bellow are allowed to input to the registers.
Mode Register Set [MRS] (
BA0 = 0, BA1 = 0)
A2 A1 A0Burst Length
BT=0 BT=1
0
0
0
0
1
1
1
0
1
2
4
8
2
4
8
A3
0
1
Sequential
Interleave
Burst Type
A6 A5 A4 CAS Latency
0
1
0
1
1
0
2
2.5
A9
A8
A7
A6
A5
A4
A3
A2
A1
A0
0
0
0
0
0
DR
LMODE
BT
BL
A8
0
1
No
Yes
DLL Reset
A11
A10
A12
BA1
0
BA0
0
MRS
Extended Mode Register Set [EMRS]
(BA0 = 1, BA1 = 0)
A0
0
1
DLL Enable
DLL Disable
DLL Control
A9
A8
A7
A6
A5
A4
A3
A2
A1
A0
0
0
0
0
0
0
0
0
0
0
0
DLL
0
A11 A10
BA1
0
BA0
1
EMRS
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PDF描述 |
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