參數(shù)資料
型號: HYS 64V4300GU
廠商: SIEMENS AG
英文描述: 3.3 V 4M × 64-Bit 1 Bank SDRAM Module(3.3 V 4M × 64-位 × 1列同步動態(tài)RAM模塊)
中文描述: 3.3伏4米× 64位一銀行內(nèi)存模塊(3.3伏分× 64 -位× 1列同步動態(tài)內(nèi)存模塊)
文件頁數(shù): 4/12頁
文件大小: 91K
代理商: HYS 64V4300GU
HYS 64V4300GU
SDRAM-Modules
Data Book
4
12.99
Functional Block Diagrams
Block Diagram: 4M
×
64 One Bank SDRAM DIMM Modules (HYS 64V4300GU)
SPB04204
DQ0-DQ7
UDQM
DQ8-DQ15
LDQM
CS
D0
CS0
DQ0-DQ7
DQMB1
DQ8-DQ15
DQMB0
DQ0-DQ7
UDQM
DQ8-DQ15
DQ32-DQ39
DQMB5
DQ40-DQ47
DQMB4
LDQM
D2
CS
A0-A11, BA0, BA1
D0-D3, (D4)
CC
V
SS
V
C
RAS, CAS, WE
CKE0
CLK1, CLK3
Clock Wiring
4 M x 64
CLK0
CLK1
CLK2
CLK3
2 SDRAM + 15 pF
Termination
2 SDRAM + 15 pF
Termination
47 k
SCL
SCL
SA0
SA1
SA2
E PROM (256 word x 8 Bit)
SA0
SA1
SA2
SDA
WP
DQ56-DQ63
DQ48-DQ55
DQMB7
DQMB6
DQMB3
DQ24-DQ31
DQMB2
DQ16-DQ23
CS2
CS
DQ8-DQ15
UDQM
LDQM
DQ0-DQ7
D1
CS
DQ8-DQ15
UDQM
LDQM
DQ0-DQ7
D3
All resistors are 10
DIMM may combine bytes 0 with 4, 1 with 5, 2 with 6 and 3 with 7 to obtain
most advantagous board layout to obtain minimum DQ trance length
Notes:
1)
2)
10 pF
D0-D3, (D4)
D0-D3, (D4)
D0-D3, (D4)
D0-D3
相關PDF資料
PDF描述
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參數(shù)描述
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