參數(shù)資料
型號: ICS548AM-03LFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 3/7頁
文件大?。?/td> 0K
描述: IC CLK INVERTER/DIVIDER 16-SOIC
標準包裝: 2,500
類型: 時鐘/頻率合成器,時鐘發(fā)生器,扇出配送
PLL:
輸入: 時鐘
輸出: 時鐘
電路數(shù): 1
比率 - 輸入:輸出: 1:3
差分 - 輸入:輸出: 無/無
頻率 - 最大: 120MHz
除法器/乘法器: 是/是
電源電壓: 3.13 V ~ 3.47 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 16-SOIC(0.154",3.90mm 寬)
供應(yīng)商設(shè)備封裝: 16-SOIC
包裝: 帶卷 (TR)
其它名稱: 548AM-03LFT
ICS548A-03
LOW SKEW CLOCK INVERTER AND DIVIDER
CLOCK DIVIDER
IDT / ICS LOW SKEW CLOCK INVERTER AND DIVIDER
3
ICS548A-03
REV C 063006
Pin Descriptions
External Components
The ICS548A-03 requires a minimum number of external components for proper operation. Decoupling capacitors
of 0.01F should be connected between pins 3 and 5, as close to the device as possible. Connect pin 2 directly to
pin 3, and pin 6 directly to pin 5. A series termination resistor of 33
should be used on all clock outputs, as close
to the device as possible. Leave any unused clock outputs floating. There are no pull-up resistors on the input pins,
and they may be connected directly to VDD or ground.
Pin
Number
Pin
Name
Pin
Type
Pin Description
1
ICLK
Input
Clock input.
2
VDD
Power
Connect to 3.3 V.
3
VDD
Power
Connect to 3.3 V.
4
S3
Input
Clock Select 3. See table on page 2.
5
GND
Power
Connect to ground.
6
GND
Power
Connect to ground.
7
S2
Input
Clock Select 2. See table on page 2.
8
S0
Input
Clock Select 0. See table on page 2.
9
S1
Input
Clock Select 1. See table on page 2.
10
OE
Input
Output Enable. Tri-states all clock outputs when low.
11
CLK/2
Output
Clock output divided by 2. See table on page 2.
12
CLK
Output
Clock output. See table on page 2.
13
CLK
Output
Inverted clock output. See table on page 2.
14
DC
Don’t connect. Do not connect anything to this pin.
15
DC
Don’t connect. Do not connect anything to this pin.
16
DC
Don’t connect. Do not connect anything to this pin.
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PDF描述
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