參數(shù)資料
型號(hào): ICS570B
元件分類: 時(shí)鐘及定時(shí)
英文描述: 570 SERIES, PLL BASED CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO8
封裝: 0.150 INCH, SOIC-8
文件頁(yè)數(shù): 3/9頁(yè)
文件大?。?/td> 199K
代理商: ICS570B
Multiplier and Zero Delay Buffer
MDS 570 I
3
Revision 030905
Integrated Circuit Systems, Inc.
525 Race Street, San Jose, CA 95126 tel (408) 297-1201 www.icst.com
ICS570
External Components
The ICS570 requires a 0.01F decoupling capacitor to be connected between VDD and GND. It must be
connected close to the part to minimize lead inductance. No external power supply filtering is required for
this device. A 33
series terminating resistor can be used next to each output pin.
Recommended Circuit
Using CLK as the feedback will always result in synchronized rising edges between ICLK and CLK.
However, the CLK/2 could be a falling edge compared with ICLK. ICS recommends using CLK/2 feedback
whenever possible. This will synchronize the rising edges of all three clocks.
CLK
CLK/2
FBIN
S1
VDD
GND
Input
S0
ICLK
x2 Mode (S1, S0 = 1, 1)
CLK Feedback
CLK
CLK/2
ICLK
x2 Mode (S1, S0 = 1, 0)
CLK/2 Feedback
CLK
CLK/2
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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