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參數(shù)資料
| 型號： | ICS580M-01I |
| 英文描述： | Glitch-Free Clock Multiplexer |
| 中文描述： | 無干擾時鐘復用器 |
| 文件頁數(shù)： | 2/6頁 |
| 文件大?。?/td> | 61K |
| 代理商： | ICS580M-01I |
ICS580-01
Glitch-Free Clock Multiplexer
MDS 580-01 A
Integrated Circuit Systems, Inc. 525 Race Street San Jose CA95126 (408) 295-9800tel www.icst.com
2
Revision 030300
Printed 11/28/00
Pin Assignment
DIV
0
1
Nominal Timeout
600 ns
75 ns
Timeout Selection
1
2
3
4
5
6
7
8
9
16
15
10
11
12
13
14
CLK1
CLK2
NO_INA
NO_INB
VDDC
DIV
VDDI
OE4
OE3
GND
INA
INB
GND
OE2
SELB
OE1
Pin Descriptions
Key: I = Input; O = output; P = power supply connection
Number
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
Name
SELB
DIV
VDDI
INA
INB
GND
OE4
OE3
OE2
GND
NO_INB
NO_INA
CLK2
CLK1
VDDC
OE1
Type
I
I
P
I
I
P
I
I
I
P
O
O
O
O
P
I
Description
Mux select. Selects INB when high. Internal pull-up.
Time out select. See table above. Internal pull-up.
Supply for input clocks only. Can be higher than VDDC.
Input Clock A.
Input Clock B.
Connect to ground.
Output Enable. Tri-states NO_INB when low. Internal pull-up.
Output Enable Tri-states NO_INA when low. Internal pull-up.
Output enable. Tri-states CLK2 when low. Internal pull-up.
Connect to ground.
Goes high when clock on INB stops.
Goes high when clock on INA stops.
Clock 2 Output. Low skew compared to CLK1.
Clock 1 Output. Low skew compared to CLK2.
Main chip supply. Output clocks amplitude will match this VDD.
Output Enable. Tri-states CLK1 when low. Internal pull-up.
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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