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參數(shù)資料
| 型號(hào)： | ICS580M-01I |
| 英文描述： | Glitch-Free Clock Multiplexer |
| 中文描述： | 無(wú)干擾時(shí)鐘復(fù)用器 |
| 文件頁(yè)數(shù)： | 4/6頁(yè) |
| 文件大小： | 61K |
| 代理商： | ICS580M-01I |
ICS580-01
Glitch-Free Clock Multiplexer
MDS 580-01 A
Integrated Circuit Systems, Inc. 525 Race Street San Jose CA95126 (408) 295-9800tel www.icst.com
4
Revision 030300
Printed 11/28/00
In the third example, the ICS580-01 is configured to automatically switch clocks when an an input stops.
The clock that could stop is connected to INA while the backup, always running, clock is connected to INB.
The output NO_INA is connected to SELB. This means that when the clock on INA stops, NO_INA
goes high selecting the clock on INB which is muxed to the output after 3 cycles. When the clock on
INA restarts, NO_INA immediately goes low, selecting the clock on INA. The output then switches in
the manner described in the first example.
The circuit diagram in Figure 3 shows a typical connection for this example. Note that CLK2 and
NO_INB are unused and so are disabled by grounding OE2 and OE4. A 33
series termination resistor
is used on the clock output and 2 decoupling capacitors of 0.01μF are used. All other inputs are left
floating and are therefore pulled high by the on-chip pull-ups.
SELB
DIV
VDDI
INA
INB
GND
OE4
OE3
OE1
VDDC
CLK1
CLK2
GND
OE2
NO_INA
VDD
0.01μF
33
0.01μF
Normal
Clock
Backup
Clock
NO_INB
Output
Clock
Figure 3
Output Enable
Each output has a dedicated output enable pin. If an output is unused, it should be tri-stated by tying the
appropriate output enable pin to ground.
External Components
The ICS580-01 requires two 0.01μF decoupling capacitors, one between VDDI and GND and one between
VDDC and GND. Series termination resistors of 33
can be used on CLK1 and CLK2.
Split Power Supplies
The VDDI pin provides the power for the INA and INB input buffers only. All the other inputs and the
rest of the chip are connected to VDDC. This allows for supply voltage translation. For example, INA and
INB could be 5 V clocks (VDDI=5 V) and the rest of the chip could use a 3.3 V supply on VDDC giving
3.3 V output clocks. For correct operation VDDI must always be greater than or equal to VDDC.
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PDF描述 |
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參數(shù)描述 |
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| ICS580M-01ILFT | 功能描述:IC CLK MUX ZERO DLAY BUFF 16SOIC RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘緩沖器，驅(qū)動(dòng)器 系列:- 標(biāo)準(zhǔn)包裝:74 系列:- 類型:扇出緩沖器（分配） 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 輸入:HCSL, LVCMOS, LVDS, LVPECL, LVTTL 輸出:HCSL，LVDS 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:32-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:32-QFN（5x5） 包裝:管件 |
| ICS580M-01IT | 功能描述:IC CLK MUX ZERO DLAY BUFF 16SOIC RoHS:否 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘緩沖器，驅(qū)動(dòng)器 系列:- 標(biāo)準(zhǔn)包裝:1 系列:HiPerClockS™ 類型:扇出緩沖器（分配），多路復(fù)用器 電路數(shù):1 比率 - 輸入:輸出:2:18 差分 - 輸入:輸出:是/無(wú) 輸入:CML，LVCMOS，LVPECL，LVTTL，SSTL 輸出:LVCMOS，LVTTL 頻率 - 最大:250MHz 電源電壓:2.375 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:32-LQFP 供應(yīng)商設(shè)備封裝:32-TQFP（7x7） 包裝:- 其它名稱:800-1923-6 |
| ICS580M-01LF | 功能描述:IC CLK MUX ZERO DLAY BUFF 16SOIC RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘緩沖器，驅(qū)動(dòng)器 系列:- 標(biāo)準(zhǔn)包裝:74 系列:- 類型:扇出緩沖器（分配） 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 輸入:HCSL, LVCMOS, LVDS, LVPECL, LVTTL 輸出:HCSL，LVDS 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:32-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:32-QFN（5x5） 包裝:管件 |
| ICS580M-01LFT | 功能描述:IC CLK MUX ZERO DLAY BUFF 16SOIC RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘緩沖器，驅(qū)動(dòng)器 系列:- 標(biāo)準(zhǔn)包裝:74 系列:- 類型:扇出緩沖器（分配） 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 輸入:HCSL, LVCMOS, LVDS, LVPECL, LVTTL 輸出:HCSL，LVDS 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:32-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:32-QFN（5x5） 包裝:管件 |
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