參數(shù)資料
型號： ICS810251AGI
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘產(chǎn)生/分配
英文描述： 25 MHz, OTHER CLOCK GENERATOR, PDSO16
封裝： 4.40 X 5 MM, 0.925 MM HEIGHT, MO-153, TSSOP-16
文件頁數(shù)： 6/13頁
文件大?。?/td> 2081K
代理商： ICS810251AGI
ICS810251I
VCXO AND SYNCHRONOUS ETHERNET JITTER ATTENUATOR
PRELIMINARY
IDT / ICS VCXO AND JITTER ATTENUATOR
2
ICS810251AGI REV. A NOVEMBER 14, 2007
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1
PLL_SEL
Input
Pullup
When logic HIGH, the VCXO-PLL is enabled. When LOW, the VCXO-PLL is in
Bypass mode. LVCMOS/LVTTL interface levels.
2, 9, 12
GND
Power
Power supply ground.
3
Reserved
Reserved pin. Leave floating and not connected
4
Q
Output
Single-ended clock output. LVCMOS/ LVTTL interface levels.
5VDDO
Power
Output power supply pin.
6
OE
Input
Pullup
Output enable pin for Q output. LVCMOS/LVTTL interface levels.
7VDDA
Power
Analog supply pin.
8, 15
VDD
Power
Power supply pins.
10,
11
XTAL_OUT,
XTAL_IN
Input
VCXO crystal oscillator interface. XTAL_IN is the input. XTAL_OUT is the
output.
13, 14
LF0, LF1
Analog
Input/
Output
Single-ended clock input. LVCMOS/ LVTTL interface levels.
16
CLK_IN
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4
pF
CPD
Power Dissipation Capacitance
VDD, VDDO = 3.465V
8
pF
VDD, VDDO = 2.625V
5
pF
RPULLUP
Input Pullup Resistor
51
k
RPULLDOWN Input Pulldown Resistor
51
k
ROUT
Output Impedance
VDDO = 3.3V±5%
15
VDDO = 2.5V±5%
20
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PDF描述
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ICS810252BI-03 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:VCXO Jitter Attenuator and FemtoClock? Multiplier
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