FEMTOCLOCK, CRYSTAL-TO-LVCMOS/LVTTL FREQUENCY SYNTHESIZER
參數(shù)資料
型號： ICS840002AGI-01LF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 10/14頁
文件大?。?/td> 0K
描述： IC FREQ SYNTHESIZER 16-TSSOP
標準包裝： 96
系列： HiPerClockS™, FemtoClock™
類型： 頻率合成器
PLL： 帶旁路
輸入： 晶體
輸出： LVCMOS，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 無/無
頻率 - 最大： 175MHz
除法器/乘法器： 是/無
電源電壓： 2.375 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 16-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 16-TSSOP
包裝： 管件
其它名稱： 800-2244
840002AGI-01LF
ICS840002AGI-01LF-ND
ICS840002I-01 Data Sheet
FEMTOCLOCK, CRYSTAL-TO-LVCMOS/LVTTL FREQUENCY SYNTHESIZER
ICS840002AGI-01 REVISION B FEBRUARY 3, 2011
5
2011 Integrated Device Technology, Inc.
AC Electrical Characteristics
Table 5A. AC Characteristics, VDD = VDDA = VDDO = 3.3V±5%, TA = -40°C to 85°C
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when the device is
mounted in a test socket with maintained transverse airflow greater than 500 lfpm. The device will meet specifications after thermal equilibrium
has been reached under these conditions.
NOTE 1: Defined as skew between outputs at the same supply voltage and with equal load conditions. Measured at VDDO/2.
NOTE 2: This parameter is defined in accordance with JEDEC Standard 65.
NOTE 3: Refer to Phase Noise Plots.
Table 5B. AC Characteristics, VDD = VDDA = 3.3V±5%, VDDO = 2.5V±5%, TA = -40°C to 85°C
For NOTES, see Table 5A above.
Table 5C. AC Characteristics, VDD = VDDA = VDDO = 2.5V±5%, TA = -40°C to 85°C
For NOTES, see Table 5A above.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
fOUT
Output Frequency
F_SEL[1:0] = 00
140
175
MHz
F_SEL[1:0] = 01
112
140
MHz
F_SEL[1:0] = 10 or 11
56
70
MHz
tsk(o)
Output Skew; NOTE 1, 2
12
ps
tjit()
RMS Phase Jitter, Random; NOTE 3
156.25MHz, (1.875MHz - 20MHz)
0.47
ps
125MHz, (1.875MHz - 20MHz)
0.57
ps
62.5MHz, (1.875MHz - 20MHz)
0.51
ps
tR / tF
Output Rise/Fall Time
20% to 80%
200
700
ps
odc
Output Duty Cycle
46
54
%
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
fOUT
Output Frequency
F_SEL[1:0] = 00
140
175
MHz
F_SEL[1:0] = 01
112
140
MHz
F_SEL[1:0] = 10 or 11
56
70
MHz
tsk(o)
Output Skew; NOTE 1, 2
12
ps
tjit()
RMS Phase Jitter, Random; NOTE 3
156.25MHz, (1.875MHz - 20MHz)
0.47
ps
125MHz, (1.875MHz - 20MHz)
0.55
ps
62.5MHz, (1.875MHz - 20MHz)
0.49
ps
tR / tF
Output Rise/Fall Time
20% to 80%
200
700
ps
odc
Output Duty Cycle
46
54
%
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
fOUT
Output Frequency
F_SEL[1:0] = 00
140
175
MHz
F_SEL[1:0] = 01
112
140
MHz
F_SEL[1:0] = 10 or 11
56
70
MHz
tsk(o)
Output Skew; NOTE 1, 2
12
ps
tjit()
RMS Phase Jitter, Random; NOTE 3
156.25MHz, (1.875MHz - 20MHz)
0.49
ps
125MHz, (1.875MHz - 20MHz)
0.56
ps
62.5MHz, (1.875MHz - 20MHz)
0.52
ps
tR / tF
Output Rise/Fall Time
20% to 80%
200
700
ps
odc
Output Duty Cycle
46
54
%
fOUT = 125MHz
47
53
%
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