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參數(shù)資料
| 型號： | ICS840002AGI-01LF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 7/14頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FREQ SYNTHESIZER 16-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 96 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | 晶體 |
| 輸出： | LVCMOS，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:2 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 175MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 16-TSSOP |
| 包裝： | 管件 |
| 其它名稱： | 800-2244 840002AGI-01LF ICS840002AGI-01LF-ND |
ICS840002I-01 Data Sheet
FEMTOCLOCK, CRYSTAL-TO-LVCMOS/LVTTL FREQUENCY SYNTHESIZER
ICS840002AGI-01 REVISION B FEBRUARY 3, 2011
2
2011 Integrated Device Technology, Inc.
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1
F_SEL0
Input
Pullup
Frequency select pin. LVCMOS/LVTTL interface levels.
2
nXTAL_SEL
Input
Pulldown
Selects between crystal or TEST_CLK inputs as the PLL reference
source. When HIGH, selects TEST_CLK. When LOW, selects XTAL
inputs. LVCMOS/LVTTL interface levels.
3
TEST_CLK
Input
Pulldown
Single-ended test clock input. LVCMOS/LVTTL interface levels.
4
OE
Input
Pullup
Output enable. When logic HIGH, the outputs are active. When LOW, the
outputs are in high-impedance state. LVCMOS/LVTTL interface levels.
5
MR
Input
Pulldown
Active High Master Reset. When logic HIGH, the internal dividers are
reset causing the active outputs to go low. When Logic LOW, the internal
dividers and the outputs are enabled. LVCMOS/LVTTL interface levels.
6
nPLL_SEL
Input
Pulldown
PLL Bypass. When LOW, the output is driven from the VCO output. When
HIGH, the PLL is bypassed and the output frequency = reference clock
frequency/N output divider. LVCMOS/LVTTL interface levels.
7VDDA
Power
Analog supply pin.
8VDD
Power
Core supply pin.
9,
10
XTAL_OUT
XTAL_IN
Input
Crystal oscillator interface. XTAL_IN is the input, XTAL_OUT is the
output.
11
VDDO
Power
Output supply pin.
12, 13
Q1, Q0
Output
Single-ended clock outputs. LVCMOS/LVTTL interface levels.
14, 15
GND
Power
Power supply ground.
16
F_SEL1
Input
Pullup
Frequency select pin. LVCMOS/LVTTL interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4
pF
CPD
Power Dissipation Capacitance
8
pF
RPULLUP
Input Pullup Resistor
51
k
RPULLDOWN
Input Pulldown Resistor
51
k
ROUT
Output Impedance
VDDO = 3.3V ± 5%
14
17
21
VDDO = 2.5V ± 5%
16
21
25
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