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參數(shù)資料
| 型號： | ICS843004AGLF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 12/20頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC SYNTHESIZER LVPECL 24-TSSOP |
| 標準包裝： | 62 |
| 系列： | HiPerClockS™, FemtoClock™ |
| 類型： | 頻率合成器 |
| PLL： | 帶旁路 |
| 輸入： | 晶體 |
| 輸出： | LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:4 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 226.66MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -30°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 24-TSSOP |
| 包裝： | 管件 |
| 其它名稱： | 800-1953-5 843004AGLF ICS843004AGLF-ND |
ICS843004
FEMTOCLOCKS LVCMOS/CRYSTAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER
IDT / ICS 3.3V LVPECL FREQUENCY SYNTHESIZER
2
ICS843004AG REV. C JANUARY 19, 2008
Table 1. Pin Descriptions
NOTE: Pulldown refers to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1, 2
nQ1, Q1
Output
Differential output pair. LVPECL interface levels.
3, 22
VCCO
Power
Output supply pins.
4, 5
Q0, nQ0
Output
Differential output pair. LVPECL interface levels.
6
MR
Input
Pulldown
Active HIGH Master Reset. When logic HIGH, the internal dividers are reset
causing the true outputs Qx to go low and the inverted outputs nQx to go high.
When logic LOW, the internal dividers and the outputs are enabled.
LVCMOS/LVTTL interface levels.
7
nPLL_SEL
Input
Pulldown
Selects between the PLL and TEST_CLK as input to the dividers. When
LOW, selects PLL (PLL Enable). When HIGH, deselects the reference clock
(PLL Bypass). LVCMOS/LVTTL interface levels.
8, 18
nc
Unused
No connect.
9VCCA
Power
Analog supply pin.
10, 12
F_SEL0.
F_SEL1
Input
Pulldown
Frequency select pins. LVCMOS/LVTTL interface levels.
11
VCC
Power
Core supply pin.
13,
14
XTAL_OUT,
XTAL_IN
Input
Parallel resonant crystal interface.
XTAL_OUT is the output, XTAL_IN is the input.
15, 19
VEE
Power
Negative supply pins.
16
TEST_CLK
Input
Pulldown
Single-ended clock input. LVCMOS/LVTTL interface levels.
17
nXTAL_SEL
Input
Pulldown
Selects between the single-ended TEST_CLK or crystal interface as the PLL
reference source. When HIGH, selects TEST_CLK. When LOW, selects
XTAL. LVCMOS/LVTTL interface levels.
20, 21
nQ3, Q3
Output
Differential output pair. LVPECL interface levels.
23, 24
Q2, nQ2
Output
Differential output pair. LVPECL interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4
pF
RPULLDOWN Input Pulldown Resistor
51
k
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