參數(shù)資料
型號： ICS8634BY-01LF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 1/17頁
文件大小： 0K
描述： IC BUFFER ZD 1:5 LVPECL 32-LQFP
標(biāo)準(zhǔn)包裝： 250
系列： HiPerClockS™
類型： 扇出配送，多路復(fù)用器，零延遲緩沖器
PLL： 帶旁路
輸入： HCSL，LVDS，LVHSTL，LVPECL，SSTL
輸出： LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:5
差分 - 輸入:輸出： 是/是
頻率 - 最大： 700MHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 32-LQFP
供應(yīng)商設(shè)備封裝： 32-TQFP（7x7）
包裝： 托盤
產(chǎn)品目錄頁面： 1249 (CN2011-ZH PDF)
其它名稱： 800-1189
8634BY-01LF
8634BY-01
www.idt.com
REV. D OCTOBER 4, 2010
1
ICS8634-01
1-TO-5 DIFFERENTIAL-TO-3.3V LVPECL
ZERO DELAY BUFFER
GENERAL DESCRIPTION
The ICS8634-01 is a high performance 1-to-5 Differential-to-
3.3V LVPECL Zero Delay Buffer. The ICS8634-01 has two
selectable clock inputs. The CLKx, nCLKx pair can accept most
standard differential input levels. Utilizing one of the outputs
as feedback to the PLL, output frequencies up to 700MHz can
be regenerated with zero delay with respect to the input. Dual
reference clock inputs support redundant clock or multiple
reference applications.
FEATURES
Five differential 3.3V LVPECL outputs
Selectable differential clock inputs
CLKx, nCLKx pair can accept the following differential
input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL
Output frequency range: 31.25MHz to 700MHz
Input frequency range: 31.25MHz to 700MHz
VCO range: 250MHz to 700MHz
External feedback for “zero delay” clock regeneration
Cycle-to-cycle jitter: 25ps (maximum)
Output skew: 25ps (maximum)
PLL reference zero delay: 50ps ± 100ps
3.3V operating supply
0°C to 70°C ambient operating temperature
Lead-Free package available
Industrial temperature information available upon request
BLOCK DIAGRAM
PIN ASSIGNMENT
32 31 30 29 28 27 26 25
9
10 11 12 13 14 15 16
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
VCCO
Q3
nQ3
Q2
nQ2
Q1
nQ1
VCCO
SEL0
SEL1
CLK0
nCLK0
CLK1
nCLK1
CLK_SEL
MR
V
CCO
Q0
nQ0
V
EE
V
EE
FB_IN
nFB_IN
V
CC
V
CCO
nQ4
Q4
V
EE
V
EE
V
CCA
PLL_SEL
V
CC
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y Package
Top View
32-Lead VFQFN
5mm x 5mm x 0.95 package body
K Package
Top View
ICS8634-01
PLL_SEL
CLK0
nCLK0
CLK1
nCLK1
CLK_SEL
FB_IN
nFB_IN
SEL0
SEL1
MR
0
1
PLL
0
1
÷4, ÷8
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
Q4
nQ4
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PDF描述
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