參數(shù)資料
型號(hào)： ICS87002AG-02LF
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 9/16頁
文件大?。?/td> 0K
描述： IC CLK GENERATOR ZD 1:2 20-TSSOP
標(biāo)準(zhǔn)包裝： 74
系列： HiPerClockS™
類型： 時(shí)鐘發(fā)生器，扇出配送，多路復(fù)用器，零延遲緩沖器
PLL： 帶旁路
輸入： HCSL，HSTL，LVDS，LVPECL，SSTL
輸出： LVCMOS，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 1:2
差分 - 輸入:輸出： 是/無
頻率 - 最大： 250MHz
除法器/乘法器： 是/是
電源電壓： 2.375 V ~ 3.465 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 20-TSSOP（0.173"，4.40mm 寬）
供應(yīng)商設(shè)備封裝： 20-TSSOP
包裝： 管件
產(chǎn)品目錄頁面： 1250 (CN2011-ZH PDF)
其它名稱： 800-1191
800-1191-5
800-1191-ND
87002AG-02LF
ICS87002AG-02 REVISION C AUGUST 9, 2010
2
2010 Integrated Device Technology, Inc.
ICS87002-02 Data Sheet
1:2, DIFFERENTIAL-TO-LVCMOS/LVTTL ZERO DELAY CLOCK GENERATOR
Table 1. Pin Descriptions
NOTE: Pullup and Pulldown refer to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1, 11, 18
GND
Power
Power supply ground.
2, 19
Q0, Q1
Output
Single-ended clock outputs. 7
typical output impedance.
LVCMOS/LVTTL interface levels.
3, 17, 20
VDDO
Power
Output supply pins.
4, 5,
6, 7
SEL0, SEL1,
SEL2, SEL3
Input
Pulldown
Determines output divider values in Table 3. LVCMOS / LVTTL interface levels.
8VDD
Power
Core supply pin.
9
CLK
Input
Pulldown
Non-inverting differential clock input.
10
nCLK
Input
Pullup/
Pulldown
Inverting differential clock input. VDD/2 default when left floating.
12
VDDA
Power
Analog supply pin.
13
PLL_SEL
Input
Pullup
PLL select. Selects between the PLL and reference clock as the input to the
dividers. When LOW, selects reference clock (PLL Bypass). When HIGH, selects
PLL (PLL enabled). LVCMOS/LVTTL interface levels.
14
FB_IN
Input
Pulldown
Feedback input to phase detector for regenerating clocks with “Zero Delay.”
Connect to one of the outputs. LVCMOS/LVTTL interface levels.
15
MR
Input
Pulldown
Active HIGH Master Reset. When logic HIGH, the internal dividers are reset causing
the outputs to go low. When logic LOW, the internal dividers and the outputs are
enabled. LVCMOS / LVTTL interface levels.
16
nc
Unused
No connect.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
CIN
Input Capacitance
4pF
RPULLUP
Input Pullup Resistor
51
k
RPULLDOWN
Input Pulldown Resistor
51
k
CPD
Power Dissipation
Capacitance (per output)
VDD, VDDA, VDDO = 3.465V
23
pF
VDD, VDDA, VDDO = 2.625V
17
pF
ROUT
Output Impedance
5
7
12
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PDF描述
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