參數(shù)資料
型號(hào)： ICS870919BRI-01LF
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 12/16頁(yè)
文件大小： 0K
描述： IC CLK GENERATOR LVCMOS 28QSOP
標(biāo)準(zhǔn)包裝： 48
系列： HiPerClockS™
類型： 時(shí)鐘發(fā)生器
PLL： 帶旁路
輸入： LVCMOS，LVTTL
輸出： LVCMOS，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 2:8
差分 - 輸入:輸出： 無(wú)/無(wú)
頻率 - 最大： 160MHz
除法器/乘法器： 是/是
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 28-SSOP（0.154"，3.90mm 寬）
供應(yīng)商設(shè)備封裝： 28-QSOP
包裝： 管件
其它名稱： 800-2397-5
ICS870919BRI-01LF-ND
ICS870919BVI-01 REVISION C JANUARY 6, 2012
5
2012 Integrated Device Technology, Inc.
ICS870919I-01 Data Sheet
LVCMOS CLOCK GENERATOR
Table 3D. FREQ_SEL Mode Configuration Table
Table 3E. PLL_EN Mode Configuration Table
Table 3F. LOCK Mode Configuration Table
Table 3G. Frequency Configuration Table
NOTE 1: The nQ5 output is inverted (180° phase shift) with respect to Q0:Q4.
NOTE 2: The input reference frequency is limited to 100MHz maximum.
Input
Operation
FREQ_SEL
0
The VCO output is frequency-divided by 2. This setting allows for a lower input frequency range.
See also table 3G for available frequency ranges.
1
The VCO output is frequency-divided by 1. This setting allows for a higher input frequency range.
See also table 3G for available frequency ranges.
Input
Operation
PLL_EN
0
The PLL is bypassed. The selected input reference clock is routed to the output dividers for low-frequency board test
purpose. The PLL-related AC specifications do not apply in PLL bypass mode.
1
The PLL is enabled and locks to the selected input reference signal.
Output
Operation
LOCK
0
PLL is not locked to the selected input reference clock.
1
PLL is locked to the selected input reference clock.
Outputs Used for
PLL Feedback
FREQ_SEL
Input Frequency Range
(MHz)
Output Frequency Range (MHz) and
Output-to-Input Frequency Multiplication Factor
SYNC[0:1]
Q[0:4], nQ5NOTE1
2XQ
Q/2
Q0, Q1, Q2,
Q3, Q4 or nQ5
0
5 - 40
5 - 40 (1x)
10 - 80 (2x)
2.5 - 20 (0.5x)
1
10 - 80
10 - 80 (1x)
20 - 160 (2x)
5 - 40 (0.5x)
2XQ
0
10 - 80
5 - 40 (0.5x)
10 - 80 (1x)
2.5 - 20 (0.25x)
1
20 - 100NOTE2
10 - 50 (0.5x)
20 - 100 (1x)
5 - 25 (0.25x)
Q/2
0
2.5 - 20
5 - 40 (2x)
10 - 80 (4x)
2.5 - 20 (1x)
1
5 - 40
10 - 80 (2x)
20 - 160 (4x)
5 - 40 (1x)
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PDF描述
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ICS870919BRILF 功能描述:IC CLK GENERATOR LVCMOS 28QSOP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:HiPerClockS™, FemtoClock™ 標(biāo)準(zhǔn)包裝:1,000 系列:Precision Edge® 類型:時(shí)鐘/頻率合成器 PLL:無(wú) 輸入:CML，PECL 輸出:CML 電路數(shù):1 比率 - 輸入:輸出:2:1 差分 - 輸入:輸出:是/是 頻率 - 最大:10.7GHz 除法器/乘法器:無(wú)/無(wú) 電源電壓:2.375 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-VFQFN 裸露焊盤，16-MLF? 供應(yīng)商設(shè)備封裝:16-MLF?（3x3） 包裝:帶卷 (TR) 其它名稱:SY58052UMGTRSY58052UMGTR-ND
ICS870919BRILFT 功能描述:IC CLK GENERATOR LVCMOS 28QSOP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:HiPerClockS™, FemtoClock™ 標(biāo)準(zhǔn)包裝:1,000 系列:- 類型:時(shí)鐘/頻率合成器，扇出分配 PLL:- 輸入:- 輸出:- 電路數(shù):- 比率 - 輸入:輸出:- 差分 - 輸入:輸出:- 頻率 - 最大:- 除法器/乘法器:- 電源電壓:- 工作溫度:- 安裝類型:表面貼裝 封裝/外殼:56-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:56-VFQFP-EP（8x8） 包裝:帶卷 (TR) 其它名稱:844S012AKI-01LFT
ICS870919BVI-01LF 功能描述:IC CLK GENERATOR LVCMOS 28PLCC RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:HiPerClockS™ 標(biāo)準(zhǔn)包裝:27 系列:Precision Edge® 類型:頻率合成器 PLL:是 輸入:PECL，晶體 輸出:PECL 電路數(shù):1 比率 - 輸入:輸出:1:1 差分 - 輸入:輸出:無(wú)/是 頻率 - 最大:800MHz 除法器/乘法器:是/無(wú) 電源電壓:3.135 V ~ 5.25 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:28-SOIC（0.295"，7.50mm 寬） 供應(yīng)商設(shè)備封裝:28-SOIC 包裝:管件
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