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參數(shù)資料
| 型號： | ICS870931ARI-01LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 1/13頁 |
| 文件大小： | 0K |
| 描述： | IC CLK GENERATOR LVCMOS 20QSOP |
| 標準包裝： | 2,500 |
| 系列： | HiPerClockS™ |
| 類型： | * |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL |
| 輸出： | LVCMOS，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:6 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 80MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-SSOP（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 20-QSOP |
| 包裝： | 帶卷 (TR) |
DATA SHEET
ICS870931ARI-01 REVISION A JUNE 11, 2009
1
2009 Integrated Device Technology, Inc.
LVCMOS Clock Generator
ICS870931I-01
General Description
The ICS870931I-01 is an LVCMOS clock generator
that uses an internal phase lock loop (PLL) for
frequency multiplication and to lock the low-skew
outputs to the reference clock. The device offers six
outputs. The PLL loop filter is completely internal and
does not require external components. Several combinations of the
PLL feedback and a divide-by-2 (controlled by FREQ_SEL) allow
applications to optimize frequency generation over a wide range of
input reference frequencies. The PLL can also be disabled by the
PLL_EN control signal to allow for low frequency or DC testing. The
ICS870931I-01 device is a member of the HiperClocks family of high
performance clock solutions from IDT.
Features
Single-ended input reference clock
Six single-ended clock outputs
Internal PLL does not require external loop filter components
5V tolerant inputs
Maximum output frequency: 80MHz, (Q0:Q4 outputs)
Maximum output frequency: 40MHz, (Q/2 output)
LVCMOS interface levels for all inputs and outputs
PLL disable feature for low-frequency testing
Output drive capability: ±24mA
Output skew: 300ps (maximum), Q0:Q4 and Q/2
Full 3.3V supply voltage
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
-40°C to 85°C ambient operating temperature
Fully pin and function compatible with the IDTQS5LV931
(including 50, 66 and 80MHz options)
HiPerClockS
ICS
Block Diagram
SYNC
FEEDBACK
PLL_EN
FREQ_SEL
OE/nRST
fREF
PLL
20MHz - 160MHz
fVCO
÷2
Q0
Q1
Q2
Q3
Q4
Q/2
÷2
÷4
0
1
0
ICS870931I-01
20-Lead QSOP, 150Mil
3.9mm x 8.65mm x 1.5mm package body
R Package
Top View
Pin Assignment
VDD
AGND
SYNC
FREQ_SEL
GND
Q0
GND
Q2
VDD
GND
Q3
PLL_EN
Q1
GND
Q4
GND
OE/nRST
AVDD
FEEDBACK
Q/2
1
2
3
4
5
6
7
8
9
10
20
19
18
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16
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