參數(shù)資料
型號: ICS8735AY-31LFT
廠商: IDT, Integrated Device Technology Inc
文件頁數(shù): 19/21頁
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描述: IC CLK GEN ZD 1:5 LVPECL 32-LQFP
標準包裝: 1,000
系列: HiPerClockS™
類型: 時鐘發(fā)生器
PLL: 帶旁路
輸入: HCSL,LVDS,LVHSTL,LVPECL,SSTL
輸出: LVPECL
電路數(shù): 1
比率 - 輸入:輸出: 2:5
差分 - 輸入:輸出: 是/是
頻率 - 最大: 350MHz
除法器/乘法器: 是/是
電源電壓: 3.135 V ~ 3.465 V
工作溫度: 0°C ~ 70°C
安裝類型: 表面貼裝
封裝/外殼: 32-LQFP
供應商設備封裝: 32-TQFP(7x7)
包裝: 帶卷 (TR)
其它名稱: 8735AY-31LFT
ICS8735-31
1:5, DIFFERENTIAL-TO-3.3V LVPECL ZERO DELAY CLOCK GENERATOR
IDT / ICS 3.3V LVPECL ZERO DELAY CLOCK GENERATOR
7
ICS8735AY-31 REV. B FEBRUARY 18, 2009
AC Electrical Characteristics
Table 6. AC Characteristics, VCC = VCCA = VCCO = 3.3V ± 5%, VEE = 0V, TA = 0°C to 70°C
NOTE: Electrical parameters are guaranteed over the specified ambient operating temperature range, which is established when the
device is mounted in a test socket with maintained transverse airflow greater than 500 lfpm. The device will meet specifications after
thermal equilibrium has been reached under these conditions.
NOTE 1: Measured from the differential input crossing point to the differential output crossing point.
NOTE 2: Defined as skew between outputs at the same supply voltage and with equal load conditions. Measured at the output differential
cross points.
NOTE 3: This parameter is defined in accordance with JEDEC Standard 65.
NOTE 4: Defined as the time difference between the input reference clock and the averaged feedback input signal across all conditions,
when the PLL is locked and the input reference frequency is stable.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
fMAX
Output Frequency
350
MHz
tPD
Propagation Delay; NOTE 1
PLL_SEL = 0, f
≤ 350MHz
3.8
5.1
ns
tsk(o)
Output Skew; NOTE 2, 3
35
ps
tsk()
Static Phase Offset; NOTE 3, 4
PLL_SEL = 1
-70
55
+180
ps
tjit(cc)
Cycle-to-Cycle Jitter; NOTE 3
60
ps
tL
PLL Lock Time
1ms
tR / tF
Output Rise/Fall Time
20% to 80%
200
750
ps
odc
Output Duty Cycle
47
53
%
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PDF描述
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參數(shù)描述
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