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參數(shù)資料
| 型號： | ICS879893BYIT |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 879893 SERIES, PLL BASED CLOCK DRIVER, 12 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP48 |
| 封裝： | 7 X 7 MM, 1.40 MM HEIGHT, MS-026, LQFP-48 |
| 文件頁數(shù)： | 5/16頁 |
| 文件大?。?/td> | 233K |
| 代理商： | ICS879893BYIT |
Integrated
Circuit
Systems, Inc.
879893BYI
www.icst.com/products/hiperclocks.html
REV. A JULY 12, 2005
13
ICS879893BI
LOW SKEW, 1-TO-12 (IDCS)
LVCMOS/LVTTL CLOCK GENERATOR
PRELIMINARY
SCHEMATIC EXAMPLE
Figure 1 shows a schematic example of the ICS879893BI. In
this example, the CLK1 input is selected as primary. Both CLK0
and CLK1 inputs are driven by LVCMOS drivers. For the
LVCMOS outputs, series termination is shown in this example.
Additional LVCMOS termination approached are shown in the
LVCMOS Termination Application Note. In this example, feed-
back trace is assumed to be a long trace. The series termina-
tion near the QFB pin is required. If the feedback trace is short,
series termination is not required. If this device is also used as a
zero delay buffer, the application note ZDB Delay Affected by
Feedback Trace provides additional information. For the power
pins, it is recommended to have at least one decoupling capaci-
tor per power pin. The decoupling capacitors should be physi-
cally located near the power pins
FIGURE 1. ICS879893BI SCHEMATIC EXAMPLE
C7
0.1u
Ro=14 Ohm
3.3V LVCMOS/LVTTL
Driv er_LVCMOS
LVCMOS
VDD
VDDO
RD1
Not Install
CLK0
VDD=3.3V
VDD
C6
0.1u
LVCMOS
Zo = 50 Ohm
F_SEL3
F_SEL2
3.3V LVCMOS/LVTTL
LVCMOS/LVTTL
VDDO
VDD
R8
10
F_SEL1
nMAN/A
VDDO
nA
LA
R
M
1
LVCMOS/LVTTL
(U1,48)
To Logic
Input
pins
R2
1K
VDD
C31
0.1u
VDD
C40
10u
(U1,5)
C3
0.1u
(U1,13)
R25
36
VDD
F_SEL0
Status indicator
(U1,44)
(U1,21)
R15
36
R1
1K
Set Logic
Input to
'0'
VDDA
R5
36
R4
36
(U1,17)
CL
K
_
IND
nA
LA
R
M
0
QB5
QA5
Zo = 50 Ohm
U1
ICS879893i
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
36
35
34
33
32
31
30
29
28
27
26
25
48
47
46
45
44
43
42
41
40
39
38
37
GND
QFB
FB
nMAN/A
VDD
CLK0
CLK1
VDD_PLL
nALARM0
nALARM1
CLK_IND
GND
VD
D
QB
5
QB
4
GN
D
VD
D
QB
3
QB
2
GN
D
VD
D
QB
1
QB
0
GN
D
VDD
nALARM_RST
REF_SEL
nPLL_EN
GND
F_SEL0
F_SEL1
GND
F_SEL2
F_SEL3
nOE/MR
VDD
VD
D
QA
5
QA
4
GN
D
VD
D
QA
3
QA
2
GN
D
VD
D
QA
1
QA
0
GN
D
VDD
Ro=14 Ohm
CLK1
LVCMOS/LVTTL
Hardwire Logic Input Pin Examples
VDDO=3.3V
C5
0.1u
C2
0.1u
LVCMOS
RU1
1K
(U1,25)
VDDO
Zo = 50 Ohm
C9
0.1u
Zo = 50 Ohm
C4
0.1u
Driv er_LVCMOS
(U1,40)
RU2
Not Ins tall
Set Logic
Input to
'1'
VDDO
C8
0.1u
C1
0.1u
To Logic
Input
pins
(U1,36)
RD2
1K
R16
36
ICS879893BI
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| ICS889474AKLF | 功能描述:IC CLK BUFFER MUX 2:2 24-VFQFPN RoHS:是 類別:集成電路 (IC) >> 時鐘/計(jì)時 - 時鐘緩沖器，驅(qū)動器 系列:HiPerClockS™ 標(biāo)準(zhǔn)包裝:74 系列:- 類型:扇出緩沖器（分配） 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 輸入:HCSL, LVCMOS, LVDS, LVPECL, LVTTL 輸出:HCSL，LVDS 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:32-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:32-QFN（5x5） 包裝:管件 |
| ICS889474AKLFT | 功能描述:IC CLK BUFFER MUX 2:2 24-VFQFPN RoHS:是 類別:集成電路 (IC) >> 時鐘/計(jì)時 - 時鐘緩沖器，驅(qū)動器 系列:HiPerClockS™ 標(biāo)準(zhǔn)包裝:74 系列:- 類型:扇出緩沖器（分配） 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 輸入:HCSL, LVCMOS, LVDS, LVPECL, LVTTL 輸出:HCSL，LVDS 頻率 - 最大:400MHz 電源電壓:3 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:32-VFQFN 裸露焊盤 供應(yīng)商設(shè)備封裝:32-QFN（5x5） 包裝:管件 |
| ICS889831AKLF | 功能描述:IC CLK BUFF 1:4 2.1GHZ 16-VFQFPN RoHS:是 類別:集成電路 (IC) >> 時鐘/計(jì)時 - 時鐘緩沖器，驅(qū)動器 系列:HiPerClockS™ 標(biāo)準(zhǔn)包裝:1 系列:HiPerClockS™ 類型:扇出緩沖器（分配），多路復(fù)用器 電路數(shù):1 比率 - 輸入:輸出:2:18 差分 - 輸入:輸出:是/無 輸入:CML，LVCMOS，LVPECL，LVTTL，SSTL 輸出:LVCMOS，LVTTL 頻率 - 最大:250MHz 電源電壓:2.375 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:32-LQFP 供應(yīng)商設(shè)備封裝:32-TQFP（7x7） 包裝:- 其它名稱:800-1923-6 |
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