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參數(shù)資料
| 型號： | ICS889834AKT |
| 英文描述： | LOW SKEW, 2-TO-4 LVCMOS/LVTTL-TO-LVPECL/ECL CLOCK MULTIPLEXER |
| 中文描述： | 低偏移，2至4的LVCMOS / LVTTL到的LVPECL / ECL時鐘復(fù)用器 |
| 文件頁數(shù)： | 4/7頁 |
| 文件大?。?/td> | 70K |
| 代理商： | ICS889834AKT |
www.icst.com/products/hiperclocks.html
Aug 02, 2002
4
Integrated
Circuit
Systems, Inc.
HiPerClockS
Application Note
3.3V LVPECL D
RIVER
T
ERMINATION
AC Coupled Termination
For AC termination, the offset level needs to be taken care of after the AC capacitors. A bias circuit might be
required. The board design engineer needs to verify what type of receiver is being driven. A few examples of AC
couple termination are shown in this section.
In Figure 6, the R3 and R4 at the driver pins provide a current path for the LVPECL driver. R1 and R2 serve as
matched load termination. The power supply V
controls the offset level so that the signal offset fall within the
VCMR input requirement of the receiver. Figure 7 and Figure 8 are equivalent to Figure 5. The Figure 7 is
equivalent to V
BB
=V
CC
-2V. This offset is suitable for interfacing with HiPerClockS
equivalent to V
=V
-1.3V. This offset is suitable for interfacing with HiPerClockS
shows AC termination with the offset bias voltage V
provided at the receiving end. Figure 10 shows AC
termination with the offset bias voltage V
provided by the receiver device. In some cases, for the receiver with
built-in bias resistors R1 and R2, the termination is shown in Figure 11.
TM
CLK/nCLK input. Figure 8 is
PCLK/nPCLK input. Figure 9
R3
100-180
C2
nTL1
Zo = 50
Td
+
-
VCCO=3.3V
R4
100-180
VBB
R2
50
C1
TL1
Zo = 50
Td
R1
50
3v3 PECL Driver
U1
Figure 6 AC Coupled with V
BB
power supply provided at the receiving end
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