參數(shù)資料
型號(hào): ICS932S208YGLF-T
英文描述: Programmable Timing Control Hub⑩ for Next Gen P4⑩ processor
中文描述: 可編程定時(shí)控制中心⑩處理器的下一代?、?/td>
文件頁(yè)數(shù): 11/14頁(yè)
文件大?。?/td> 105K
代理商: ICS932S208YGLF-T
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ICS932S202
0600A—08/04/03
Power Management Features:
Note:
1. LOW means outputs held static LOW as per latency requirement next page.
2. On means active.
3. PD# pulled Low, impacts all outputs including REF and 48 MHz outputs.
Power Management Requirements:
Note:
1. Clock on/off latency is defined in the number of rising edges of free running PCICLKs between the clock disable goes
low/high to the first valid clock comes out of the device.
2. Power up latency is when PWR_DWN# goes inactive (high to when the first valid clocks are dirven from the device.
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PDF描述
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參數(shù)描述
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