參數(shù)資料
型號: ICS9DB104YGLFT
元件分類: 時鐘及定時
英文描述: 9DB SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
封裝: 4.40 MM, 0.65 MM, ROHS COMPLIANT, MO-153, TSSOP-28
文件頁數(shù): 12/14頁
文件大小: 132K
代理商: ICS9DB104YGLFT
7
Integrated
Circuit
Systems, Inc.
ICS9DB104
0767D—10/26/05
SMBus Table: Frequency Select Register, READ/WRITE ADDRESS (DC/DD)
Pin #
Name
Control
Function
Type
0
1
PWD
Bit 7
RW
driven
Hi-Z
0
Bit 6
RW
driven
Hi-Z
0
Bit 5
RW
X
Bit 4
RW
X
Bit 3
RW
X
Bit 2
RW High BW Low BW
1
Bit 1
RW
fan-out
ZDB
1
Bit 0
RW
div /2
x1
1
SMBus Table: Output Control Register
Pin #
Name
Control
Function
Type
0
1
PWD
Bit 7
RW
1
Bit 6
DIF_6
Output
Control
RW
Disable
Enable
1
Bit 5
DIF_5
Output
Control
RW
Disable
Enable
1
Bit 4
RW
1
Bit 3
RW
1
Bit 2
DIF_2
Output
Control
RW
Disable
Enable
1
Bit 1
DIF_1
Output
Control
RW
Disable
Enable
1
Bit 0
RW
1
SMBus Table: Output Control Register
Pin #
Name
Control
Function
Type
0
1
PWD
Bit 7
RW
0
Bit 6
DIF_6
Output
Control
RW
Free-run Stoppable
0
Bit 5
DIF_5
Output
Control
RW
Free-run Stoppable
0
Bit 4
RW
0
Bit 3
RW
0
Bit 2
DIF_2
Output
Control
RW
Free-run Stoppable
0
Bit 1
DIF_1
Output
Control
RW
Free-run Stoppable
0
Bit 0
RW
0
Byte 0
-
PD# drive mode
-
SRC_Stop# drive
-
Reserved
-
Reserved
-
Reserved
-
PLL_BW# adjust
-
BYPASS#/PLL
-
SRC_DIV#
Byte 1
-
23,22
20,19
-
9,10
6,7
-
Byte 2
-
23,22
20,19
-
9,10
6,7
-
Reserved
User should write '0'
to minimize power
Reserved
User should write '0'
to minimize power
Reserved
User should write '0'
to minimize power
Reserved
User should write '0'
to minimize power
Reserved
相關(guān)PDF資料
PDF描述
ICS9FG108CG-T 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
ICSSSTUAF32868BHLFT 32868 SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PBGA176
IDT2309-1HDCGI8 PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
IDT54FCT373CTEB FCT SERIES, 8-BIT DRIVER, TRUE OUTPUT, CDFP20
IDT5V996BBI 5V SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PBGA144
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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