參數(shù)資料
型號： ICS9DB401CGT
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘及定時
英文描述： 9DB SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
封裝： 0.40 X 0.65 MM, MO-153, TSSOP-28
文件頁數(shù)： 10/17頁
文件大小： 243K
代理商： ICS9DB401CGT
IDTTM/ICSTM
Four Output Differential Buffer for PCI Express
ICS9DB401C
REV C 05/22/07
ICS9DB401C
Four Output Differential Buffer for PCI Express
Pin Configuration
28-pin SSOP & TSSOP
VDD 1
28 VDDA
SRC_IN 2
27 GNDA
SRC_IN# 3
26 IREF
GND 4
25 OE_INV
VDD 5
24 VDD
DIF_1 6
23 DIF_6
DIF_1# 7
22 DIF_6#
OE_1 821 OE_6
DIF_2 9
20 DIF_5
DIF_2# 10
19 DIF_5#
VDD 11
18 VDD
BYPASS#/PLL 12
17 HIGH_BW#
SCLK 13
16 SRC_STOP#
SDATA 14
15 PD#
OE_INV = 0
IC
S9D
B
401
(sam
e
as
I
C
S
9
DB
1
04)
VDD 1
28 VDDA
SRC_IN 2
27 GNDA
SRC_IN# 3
26 IREF
GND 425 OE_INV
VDD 524 VDD
DIF_1 623 DIF_6
DIF_1# 722 DIF_6#
OE1# 821 OE6#
DIF_2 920 DIF_5
DIF_2# 10
19 DIF_5#
VDD 11
18 VDD
BYPASS#/PLL 12
17 HIGH_BW#
SCLK 13
16 SRC_STOP
SDATA 14
15 PD
OE_INV = 1
ICS9
DB
401
Power Groups
VDD
GND
1
4
SRC_IN/SRC_IN#
5,11,18, 24
4
DIF(1,2,5,6)
N/A
27
IREF
28
27
Analog VDD & GND for PLL core
Description
Pin Number
Polarity Inversion Pin List Table
01
8
OE_1
OE1#
15
PD#
PD
16
DIF_STOP#
DIF_STOP
21
OE_6
OE6#
Pins
OE_INV
相關(guān)PDF資料
PDF描述
ICS9DB401CFLF 9DB SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
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ICS9DB401YGT 9DB SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
ICS9DB403DFLFT 9DB SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
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參數(shù)描述
ICS9DB403DFILF 功能描述:IC BUFFER 4OUTPUT DIFF 28-SSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 專用 系列:PCI Express® (PCIe) 標(biāo)準(zhǔn)包裝:28 系列:- 類型:時鐘/頻率發(fā)生器 PLL:是 主要目的:Intel CPU 服務(wù)器 輸入:時鐘 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:3:22 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:64-TFSOP （0.240"，6.10mm 寬） 供應(yīng)商設(shè)備封裝:64-TSSOP 包裝:管件
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