參數(shù)資料
型號(hào)： ICS9FG108CG-T
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時(shí)鐘產(chǎn)生/分配
英文描述： 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
封裝： 6.10 MM, 0.50 MM PITCH, MO-153, TSSOP-48
文件頁數(shù)： 13/19頁
文件大?。?/td> 229K
代理商： ICS9FG108CG-T
3
Integrated
Circuit
Systems, Inc.
ICS9FG108
0823E—04/13/06
Pin Description (Continued)
PIN #
PIN NAME
PIN TYPE
DESCRIPTION
25
DIF_STOP#
IN
Active low input to stop differential output clocks.
26
SPREAD
IN
Asynchronous, active high input, with internal 120Kohm pull-up
resistor, to enable spread spectrum functionality.
27
SEL14M_25M#
IN
Select 14.31818 MHz or 25 Mhz input frequency. 1 = 14.31818
MHz, 0 = 25 MHz
28
OE_3**
IN
Active high input for enabling output 3.
0 = tri-state outputs, 1= enable outputs
29
DIF_3#
OUT
0.7V differential complement clock output
30
DIF_3
OUT
0.7V differential true clock output
31
VDD
PWR
Power supply, nominal 3.3V
32
DIF_2#
OUT
0.7V differential complement clock output
33
DIF_2
OUT
0.7V differential true clock output
34
OE_2*
IN
Active high input for enabling output 2.
0 = tri-state outputs, 1= enable outputs
35
GND
PWR
Ground pin.
36
VDD
PWR
Power supply, nominal 3.3V
37
OE_1*
IN
Active high input for enabling output 1.
0 = tri-state outputs, 1= enable outputs
38
DIF_1#
OUT
0.7V differential complement clock output
39
DIF_1
OUT
0.7V differential true clock output
40
VDD
PWR
Power supply, nominal 3.3V
41
DIF_0#
OUT
0.7V differential complement clock output
42
DIF_0
OUT
0.7V differential true clock output
43
OE_0**
IN
Active high input for enabling output 0.
0 = tri-state outputs, 1= enable outputs
44
FS1
IN
3.3V Frequency select latched input pin.
45
FS0
IN
3.3V Frequency select latched input pin.
46
IREF
OUT
This pin establishes the reference current for the differential current-
mode output pairs. This pin requires a fixed precision resistor tied
to ground in order to establish the appropriate current. 475 ohms is
the standard value.
47
GNDA
PWR
Ground pin for the PLL core.
48
VDDA
PWR
3.3V power for the PLL core.
Note:
Pin names followed by '**' have 120 Kohm pull DOWN resistors
Pin names followed by '*' have 120 Kohm pull UP resistors
相關(guān)PDF資料
PDF描述
ICSSSTUAF32868BHLFT 32868 SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PBGA176
IDT2309-1HDCGI8 PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO16
IDT54FCT373CTEB FCT SERIES, 8-BIT DRIVER, TRUE OUTPUT, CDFP20
IDT5V996BBI 5V SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PBGA144
IDT5V996BBI8 5V SERIES, PLL BASED CLOCK DRIVER, 8 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PBGA144
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參數(shù)描述
ICS9FG108DFILF 功能描述:IC FREQ TIMING GENERATOR 48-SSOP RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 專用 系列:PCI Express® (PCIe) 標(biāo)準(zhǔn)包裝:28 系列:- 類型:時(shí)鐘/頻率發(fā)生器 PLL:是 主要目的:Intel CPU 服務(wù)器 輸入:時(shí)鐘 輸出:LVCMOS 電路數(shù):1 比率 - 輸入:輸出:3:22 差分 - 輸入:輸出:無/是 頻率 - 最大:400MHz 電源電壓:3.135 V ~ 3.465 V 工作溫度:0°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:64-TFSOP （0.240"，6.10mm 寬） 供應(yīng)商設(shè)備封裝:64-TSSOP 包裝:管件
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