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參數資料
| 型號： | ICS9FG108CGLF |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘產生/分配 |
| 英文描述： | 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48 |
| 封裝： | 6.10 MM WIDTH, 0.50 MM PITCH, ROHS COMPLIANT, MO-153, TSSOP-48 |
| 文件頁數： | 16/19頁 |
| 文件大小： | 252K |
| 代理商： | ICS9FG108CGLF |
IDTTM/ICSTM
Frequency Generator for CPU, QPI, FBD, PCIe Gen 2 & SATA
ICS9FG108
REV G 04/06/07
ICS9FG108
Frequency Generator for CPU, QPI, FBD, PCIe Gen 2 & SATA
6
SMBus Table: Device Control Register, READ/WRITE ADDRESS (DC/DD)
Pin #
Name
Control Function
Type0
1
PWD
Bit 7
RW
Pin 27
Bit 6
RW
Pin 6
Bit 5
RW
Pin 44
Bit 4
RW
Pin 45
Bit 3
RW
Off
On
Pin 26
Bit 2
RW
Hardware
Select
Software
Select
0
Bit 1
RW
Driven
Hi-Z
0
Bit 0
RW
Down
Center
0
Notes:
1. These bits reflect the state of the corresponding pins at power up, but may be written to
if Byte 0, bit 2 is set to '1'. FS3 is the SEL14M_25M# pin.
SMBus Table: Output Enable Register
Pin #
Name
Control Function
Type0
1
PWD
Bit 7
DIF_7 EN
Output Enable
RW
Disable
Enable
1
Bit 6
DIF_6 EN
Output Enable
RW
Disable
Enable
1
Bit 5
DIF_5 EN
Output Enable
RW
Disable
Enable
1
Bit 4
DIF_4 EN
Output Enable
RW
Disable
Enable
1
Bit 3
DIF_3 EN
Output Enable
RW
Disable
Enable
1
Bit 2
DIF_2 EN
Output Enable
RW
Disable
Enable
1
Bit 1
DIF_1 EN
Output Enable
RW
Disable
Enable
1
Bit 0
DIF_0 EN
Output Enable
RW
Disable
Enable
1
SMBus Table: Output Stop Mode Register
Pin #
Name
Control Function
Type0
1
PWD
Bit 7
DIF_7 STOP EN
Free Run/ Stop Enable
RW
Free-run
Stop-able
0
Bit 6
DIF_6 STOP EN
Free Run/ Stop Enable
RW
Free-run
Stop-able
0
Bit 5
DIF_5 STOP EN
Free Run/ Stop Enable
RW
Free-run
Stop-able
0
Bit 4
DIF_4 STOP EN
Free Run/ Stop Enable
RW
Free-run
Stop-able
0
Bit 3
DIF_3 STOP EN
Free Run/ Stop Enable
RW
Free-run
Stop-able
0
Bit 2
DIF_2 STOP EN
Free Run/ Stop Enable
RW
Free-run
Stop-able
0
Bit 1
DIF_1 STOP EN
Free Run/ Stop Enable
RW
Free-run
Stop-able
0
Bit 0
DIF_0 STOP EN
Free Run/ Stop Enable
RW
Free-run
Stop-able
0
See Frequency
Selection Table, Page 1
SEL14M_25M#
1
(FS3)
FS2
1
FS1
1
FS0
1
-
Byte 2
-
Byte 1
-
DIF_STOP# drive mode
-
Spread Type
26
Spread Enable
1
-
Enable Software Control of Frequency, Spread
Enable (Spread Type always Software Control)
44
45
Byte 0
27
6
相關PDF資料 |
PDF描述 |
|---|---|
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| ICSLV810FI | 810 SERIES, LOW SKEW CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
| ICSLV810FIT | 810 SERIES, LOW SKEW CLOCK DRIVER, 10 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20 |
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參數描述 |
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